7位伪随机码发生器设计

南昌大学实验报告

学生姓名：学号：专业班级：电子092班

实验类型：□验证□综合 设计□创新实验日期：实验成绩：

课题一 7位伪随机码发生器设计

一、实验目的

1、了解数字信号的波形特点；

2、掌握D触发器延时设计数字电路的原理及方法；

3、熟悉Multisim 10.0软件的使用。

二、设计要求

设计一个7位伪随机码发生器，输出相对码，要求输出的波形没有毛刺和抖动，波形稳定效果好。

三、实验原理与仿真电路

要产生7位伪随机码，根据M=2n-1=7,所以n=3，需要3个D触发器，在32KHz正弦波或方波的时钟信号触发下，第三个D触发器输出端产生1110010的7位伪随机绝对码。由于要输出相对码，故须将a n与b n-1 异或产生b n信号（0100011），这里用到了第四个D触发器，电路如下：

其中函数信号发生器产生32KHz正弦信号，D触发器的U2A的5脚输出7位伪随机绝对码，U3A异或门输出的信号为b n，输入的两个信号分别为a n和b n-1。用逻辑分析仪可以观察信号a n和b n-1的波形。

四、实验波形

如图，最上方波形为7为伪随机绝对码，中间的为7位伪随机相对码，波形无延时，稳定。达到实验设计要求。

五、实验心得与体会

通过本次设计实验，复习巩固了数字电路逻辑设计的知识，对于D触发器延时有了更进一步的认识，同时也熟练了Multisim软件的使用，为后续综合设计实验打下了基础。