第EDA技术使用教程课后答案5章

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5.1.4 全程编译
图5-9 全程编译后出现报错信息
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5.1 基本设计流程
5.1.5 时序仿真
图5-10 选择编辑矢量波形文件
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5.1 基本设计流程
5.1.5 时序仿真
图5-11 波形编辑器
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5.1 基本设计流程
5.1.5 时序仿真
图5-12 设置仿真时间长度
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5.4 原理图输入设计方法
5. 将设计项目设置成工程和时序仿真
图5-46 加入本工程所有文件
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5.4 原理图输入设计方法
5. 将设计项目设置成工程和时序仿真
全加器工程f_adder的仿真波形 图5-47 全加器工程 的仿真波形
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5.4 原理图输入设计方法
5.4.2 应用宏模块的原理图设计 1. 计数器设计
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5.3 嵌入式逻辑分析仪使用方法
5．编译下载 启动SignalTap II进行采样与分析 6．启动SignalTap II进行采样与分析
下载cnt10.sof并准备启动 并准备启动SignalTap II 图5-39 下载 并准备启动
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5.3 嵌入式逻辑分析仪使用方法
启动SignalTap II进行采样与分析 6．启动SignalTap II进行采样与分析
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5.1 基本设计流程
5.1.2 创建工程
图5-3 将所有相关的文件都加入进此工程
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5.1 基本设计流程
5.1.2 创建工程
选择目标器件EP2C5T144C8 图5-4 选择目标器件
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5.1 基本设计流程
5.1.2 创建工程
工程转换为QuartusII工程 图5-5 将Max+plusII工程转换为 工程转换为 工程
EDA 技术实用教程
第 5 章 QuartusII 应用向导
5.1 基本设计流程
5.1.1 建立工作库文件夹和编辑设计文件
选择编辑文件的语言类型， 图5-1 选择编辑文件的语言类型，键入源程序并存盘
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5.1 基本设计流程
5.1.2 创建工程
利用“ 创建工程cnt10 图5-2 利用“New Preject Wizard”创建工程 创建工程
5.2 引脚设置和下载
5.2.2 配置文件下载
图5-26加入编程下载方式 加入编程下载方式
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5.2 引脚设置和下载
5.2.2 配置文件下载
图5-27 双击选中的编程方式名
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5.2 引脚设置和下载
5.2.2 配置文件下载
图5-28 ByteBlasterII编程下载窗 编程下载窗
5.4 原理图输入设计方法
5.4.2 应用宏模块的原理图设计 1. 计数器设计
2.0µs 4.0µs 6.0µs 8.0µs 10.0µs
图5-49 两位十进制计数器工作波形
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向原理图编辑窗中调入宏功能元件如图3-5所示，直接在上端的 向原理图编辑窗中调入宏功能元件如图 所示，直接在上端的Symbol Name栏中键 所示 栏中键 入器件的名称， 键即可。 内部的情况， 入器件的名称，如74390等，然后点击 等 然后点击OK键即可。如果要了解 键即可 如果要了解74390内部的情况，可以 内部的情况 用鼠标在其上双击。最后根据图3-4在原理图编辑窗中完成该电路的全部绘制。绘制过 用鼠标在其上双击。最后根据图 在原理图编辑窗中完成该电路的全部绘制。 在原理图编辑窗中完成该电路的全部绘制 程中应特别注意图形设计规则中信号标号和总线的表达方式： 程中应特别注意图形设计规则中信号标号和总线的表达方式： 若将一根细线变成以粗线显示的总线，可以先将其点击使其变成红色，再选 若将一根细线变成以粗线显示的总线，可以先将其点击使其变成红色，再选Option 选项中的Line Style ；若在某线上加信号标号，也应该在该线某处点击使其变成红色， 若在某线上加信号标号，也应该在该线某处点击使其变成红色， 选项中的 然后键入标号名称，标有相同标号的线段可视作连接线段，但可不必直接连接。 然后键入标号名称，标有相同标号的线段可视作连接线段，但可不必直接连接。对于以 标号方式进行总线连接可以如图3-4那样 例如一根8位的总线 那样。 位的总线bus1(7..0)欲与另 根分 欲与另3根分 标号方式进行总线连接可以如图 那样。例如一根 位的总线 欲与另 别为1、 、 位的连线相接 它们的标号可分别表示为bus1(0)，bus1(3..1)， 位的连线相接， 别为 、3、4位的连线相接，它们的标号可分别表示为 ， ， bus1(7..4)。 。 3、波形仿真，按照第一章介绍的流程能够很容易地得到图 电路的仿真波形（图3电路的仿真波形（ 、波形仿真，按照第一章介绍的流程能够很容易地得到图3-4电路的仿真波形 7）。由波形图3-7可见，图3-4电路的功能完全符合原设计要求：当clk输入时钟信号时， ）。由波形图 可见， 电路的功能完全符合原设计要求： 输入时钟信号时， ）。由波形图 可见 电路的功能完全符合原设计要求 输入时钟信号时 clr信号具有清 功能，当enb为高电平时允许计数，低电平时禁止计数；当低 位计数器 信号具有清0功能 为高电平时允许计数， 信号具有清 功能， 为高电平时允许计数 低电平时禁止计数；当低4位计数器 计到9的向高 位计数器进位，另外由于图2-4中没有显示高 位计数器计到9， 的向高4位计数器进位 中没有显示高4位计数器计到 计到 的向高 位计数器进位，另外由于图 中没有显示高 位计数器计到 ，故看不到 count的进位信号。 的进位信号。 的进位信号 如果本设计电路的存盘文件名为conter8.gdf ，则按照步骤 的第 段介绍的方法，将 则按照步骤5的第 段介绍的方法， 的第9段介绍的方法 如果本设计电路的存盘文件名为 此项设计包装成一个元件存入库中以备后用，该电路对应的元件名是conter8 。 此项设计包装成一个元件存入库中以备后用，该电路对应的元件名是
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5.2 引脚设置和下载
5.2.3 AS模式编程配置器件 模式编程配置器件
接口AS模式编程窗口 图5-29 ByteBlaster II接口 模式编程窗口 接口
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5.2 引脚设置和下载
5.2.4 JTAG间接模式编程配置器件 间接模式编程配置器件
选择目标器件EP2C5T144 图5-30 选择目标器件
图5-36 SignalTap II编辑窗 编辑窗
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5.3 嵌入式逻辑分析仪使用方法
2．调入待测信号 II参数设置 3．SignalTap II参数设置
图5-37 SignalTap II编辑窗 编辑窗
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5.3 嵌入式逻辑分析仪使用方法
4．文件存盘
设定SignalTap II与工程一同综合适配 图5-38 设定 与工程一同综合适配
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5.2 引脚设置和下载
5.2.1 引脚锁定
图5-23 Assignment Editor编辑器 编辑器
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5.2 引脚设置和下载
5.2.1 引脚锁定
图5-24 两种引脚锁定对话框
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5.2 引脚设置和下载
5.2.2 配置文件下载
图5-25 选择编程下载文
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图5-48 含有时钟使能的两位十进制计数器
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双十进制计数器74390
1CLR 计数器1 清零 1CLKA 1QA进行二进制计数 1CLKB 1QB1QC1QD进行五进制计数（D 为高位） 2CLR 计数器2 清零 2CLKA 2QA进行二进制计数 2CLKB 2QB2QC2QD进行五进制计数（D 为高位）
图5-43 将所需元件全部调入原理图编辑窗并连接好
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5.4 原理图输入设计方法
4. 设计全加器顶层文件
连接好的全加器原理图f_adder.bdf 图5-44 连接好的全加器原理图
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5.4 原理图输入设计方法
5. 将设计项目设置成工程和时序仿真
图5-45 f_adder.bdf工程设置窗 工程设置窗
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5.1 基本设计流程
5.1.3 编译前设置
选择目标器件EP2C5T144C8 图5-6 选择目标器件
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5.1 基本设计流程
5.1.3 编译前设置
图5-7选择配置器件的工作方式 选择配置器件的工作方式
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5.1 基本设计流程
5.1.3 编译前设置
图5-8 选择配置器件和编程方式
5.4.1 设计流程
1. 为本项工程设计建立文件夹 假设本项设计的文件夹取名为adder， ， 假设本项设计的文件夹取名为 路径为：d:\adder。 路径为： 。
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5.4 原理图输入设计方法
2. 输入设计项目和存盘
图5-42 元件输入对话框
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5.4 原理图输入设计方法
3. 将设计项目设置成可调用的元件
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5.2.5 USB Blaster编程配置器件使用方法 编程配置器件使用方法
安装USB驱动程序 图5-33 安装 驱动程序
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5.2 引脚设置和下载
5.2.5 USB Blaster编程配置器件使用方法 编程配置器件使用方法
设置JTAG硬件功能 图5-34 设置 硬件功能
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5.2.4 JTAG间接模式编程配置器件 间接模式编程配置器件
选定SOF文件后，选择文件压缩 文件后， 图5-31 选定 文件后
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5.2 引脚设置和下载
5.2.4 JTAG间接模式编程配置器件 间接模式编程配置器件
模式对配置器件EPCS1进行间接编程 图5-32 用JTAG模式对配置器件 模式对配置器件 进行间接编程
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5.1 基本设计流程
5.1.5 时序仿真
图5-13 vwf激励波形文件存盘 激励波形文件存盘
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5.1.5 时序仿真
图5-14 向波形编辑器拖入信号节点
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5.1 基本设计流程
5.1.5 时序仿真
设置时钟CLK的周期 图5-15 设置时钟 的周期
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5.1 基本设计流程
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5.1 基本设计流程
5.1.5 时序仿真
图5-20 选择全时域显示
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5.1.6 应用 应用RTL电路图观察器 电路图观察器
工程的RTL电路图 图5-21 cnt10工程的 工程的 电路图
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5.2.1 引脚锁定
实验系统模式5实验电路图 图5-22 GW48实验系统模式 实验电路图 实验系统模式
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5.2 引脚设置和下载
5.2.5 USB Blaster编程配置器件使用方法 编程配置器件使用方法
中使用USB Blaster 图5-35 在In-System Memory Content Editor中使用 中使用
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5.3 嵌入式逻辑分析仪使用方法
打开SignalTap II编辑窗 1．打开SignalTap II编辑窗
图5-40 SignalTap II采样已被启动 采样已被启动
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5.3 嵌入式逻辑分析仪使用方法
II的其他设置和控制方法 7．SignalTap II的其他设置和控制方法
图5-41 SignalTap II数据窗设置后的信号波形 数据窗设置后的信号波形
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5.4 原理图输入设计方法
1、设计电路原理图，频率计的核心元件之一是含有时钟使能及进位扩展输出的十进 、设计电路原理图， 制计数器。为此这里拟用一个双十进制计数74390和其它一些辅助元件来完成。电路 和其它一些辅助元件来完成。 制计数器。为此这里拟用一个双十进制计数 和其它一些辅助元件来完成 原理图如图3-4所示。图中，74390连接成两个独立的十进制计数器，待测频率信号 原理图如图 所示。图中， 连接成两个独立的十进制计数器， 所示 连接成两个独立的十进制计数器 clk通过一个与门进入 通过一个与门进入74390的计数器 的时钟输入端 的计数器1的时钟输入端 通过一个与门进入 的计数器 的时钟输入端1CLKA，与门的另一端由计数使 ， 能信号enb控制：当enb = '1' 时允许计数；enb = '0' 时禁止计数。计数器 的4位输出 控制： 时允许计数； 时禁止计数。计数器1的 位输出 能信号 控制 q[3]、q[2]、q[1]和q[0]并成总线表达方式即 并成总线表达方式即q[3..0]，由图 左下角的 左下角的OUTPUT输出 、 、 和 并成总线表达方式即 ，由图3-4左下角的 输出 端口向外输出计数值，同时由一个4输入与门和两个反相器构成进位信号进入第 输入与门和两个反相器构成进位信号进入第2个计 端口向外输出计数值，同时由一个 输入与门和两个反相器构成进位信号进入第 个计 数器的时钟输入端2CLKA。 数器的时钟输入端 。 个计数器的4位计数输出是 第2个计数器的 位计数输出是 个计数器的 位计数输出是q[7]、q[6]、q[5]和q[4]，总线输出信号是 、 、 和 ，总线输出信号是q[7..4]。这 。 两个计数器的总的进位信号，即可用于扩展输出的进位信号由一个6输入与门和两个 两个计数器的总的进位信号，即可用于扩展输出的进位信号由一个 输入与门和两个 反相器产生， 输出。 是计数器的清零信号 是计数器的清零信号。 反相器产生，由cout输出。clr是计数器的清零信号。 输出 2、计数器电路实现，在此首先从实现图 所示的电路的绘制和测试开始，用鼠标双 所示的电路的绘制和测试开始， 、计数器电路实现，在此首先从实现图3-4所示的电路的绘制和测试开始 击“Enter Symbol”窗中 窗中Symbol Libraries栏的 栏的e:\maxplus2\max2lib\mf的宏功能元 的宏功能元 窗中 栏的 件库，于是可以在Symbol Files栏中看到绝大多数 系列的元件（图3-5）。这些器 栏中看到绝大多数74系列的元件 ）。这些器 件库，于是可以在 栏中看到绝大多数 系列的元件（ ）。 件的详细功能及其它们的逻辑真值表可以通过查阅“ 选项来获得。 件的详细功能及其它们的逻辑真值表可以通过查阅“Help”选项来获得。为了查阅 选项来获得 74390的功能，可如图 所示，在Help菜单中选 的功能， 所示， 菜单中选Old-Style Macrofunctions项，然后 的功能 可如图3-6所示 菜单中选 项 选Counters项。 项
5.1.5 时序仿真
图5-16 选择总线数据格式
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5.1.5 时序仿真
图5-17设置好的激励波形图 设置好的激励波形图
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康芯科技Leabharlann Baidu
5.1 基本设计流程
5.1.5 时序仿真
图5-18 选择仿真控制
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5.1 基本设计流程
5.1.5 时序仿真
图5-19 仿真波形输出