余3码转换成2421 BCD 码
- 1、下载文档前请自行甄别文档内容的完整性，平台不提供额外的编辑、内容补充、找答案等附加服务。
- 2、"仅部分预览"的文档,不可在线预览部分如存在完整性等问题,可反馈申请退款(可完整预览的文档不适用该条件!)。
- 3、如文档侵犯您的权益，请联系客服反馈,我们会尽快为您处理(人工客服工作时间：9:00-18:30)。
课程设计任务书
学生姓名：许玉林学生专业班级：计算机0902班
指导教师：陈建军学院名称：计算机科学与技术学院
一、题目：余3码转换成2421 BCD 码
原始条件：使用“与”门( 74 LS 08 )、“或”门( 74 LS 32 )、非门( 74 LS 04 )，设计余3码转换成8421 BCD 码。
二、要求完成设计的主要任务如下：
1．能够运用数字逻辑的理论和方法，把时序逻辑电路设计和组合逻辑电路设计相结合，设计一个有实际应用的数字逻辑电路。
2．使用同步时序逻辑电路的设计方法，设计余3码转换成2421 BCD 码。写出设计中的三个过程。画出课程设计图。
3．根据74 LS 08、74 LS 32、74 LS 04集成电路引脚号，在设计好的余3码转换成2421 BCD 码电路图中标上引脚号。
4．在试验设备上，使用74 LS 08、74 LS 32、74 LS 04集成电路连接、调试和测试余3码转换成2421 BCD 码电路。
三、课程设计进度安排：
课程设计正文
一、根据要求列出真值表。在该课程设计中，余3码有0011~1100十种输入，另外0000~0010和1101~1111六种输入是不可能发生的。因此
m~2m和13m~15m是该实验中的无关小项。根据课程设计要求列出的真值表如表1-1所示。
表1-1真值表
二、写出函数逻辑表达式
1(8,9,10,11,12)(0,1,2,13,14,15)
Y m d =+
∑∑
2(7,9,10,11,12)(0,1,2,13,14,15)
Y m d =+
∑∑
3(5,6,8,11,12)(0,1,2,13,14,15)
Y m d =+
∑∑
4(4,6,8,10,12)(0,1,2,13,14,15)Y m d =
+∑∑
化简逻辑函数1Y 、2Y 、3Y 和4Y 。图1-11是课程设计题目的卡诺图。卡诺图a 、b 、c 、d 中的无关小项填入“d ”,然后在小方格上填“1”，再进行逻辑函数的化简。逻辑函数1Y 、2Y 、3Y 和4Y 化简如下所示。
图1-11 卡诺图及其化简
三、画出组合逻辑电路图（见图1-12）
2AD AC BCD ++4Y D = 1Y A =3 )a )d
图1-12组合逻辑电路图四、在逻辑电路图中标出集成电路引脚
其对应逻辑图标上引脚后如下图1-13：
五、逻辑电路线路连接
1、因为是4个输入和4个输出。那么就可以将电路板上的4个灯作为输入信号，把剩下的4个灯作为输出信号（说明：这里，
1 2
3
4
5
6
1 2 3
4 5 6
13 12 11
9 10
8 16 15 18 17
19 24 20
23 22
26 27 29 30 32 31
33
35 1 2
3
4 5 11
9
10
12 13 图1-13 表上引脚后的逻辑电路图
将前4个灯作为输入信号，将后4个灯作为输出信号）如图1-14所示：
2、信号灯中，灯亮则表示为“0”，灯不亮则表示为“1”。
六、课程设计结果分析、小结及心得体会 结果分析：
此课程设计中只有最后在电路板上连接时，由于线路接触问题，所以导致有少数几组结果有时能正常显示，有时不能正常显示（如图1-15左图），但大部分结果能正常显示（如图1-14、图1-15右图和图
此处前4个灯作为输入信号，后4个灯作为输出信号；输入为“1001”，输出为“1100”
此处连接电源Va(由
红色导线连接)和接地GND （由蓝色导线连接）
图1-14 逻辑电路线路连接
1-16）。
课程设计小结及心得体会
1．通过此次课程设计，是我学会了运用数字逻辑的理论和方法，把时序逻辑电路设计和组合逻辑电路设计相结合，设计一个有实际应用的数字逻辑电路。
2．使用同步时序逻辑电路的设计方法，设计余3码转换成2421 BCD 码，在画出课程设计图时，应该尽量使“门”元件对整齐，保证美观。
3．将74 LS 08、74 LS 32、74 LS 04集成电路引脚号，在设计好的余3码转换成2421 BCD 码电路图中标上引脚号时，可以直接只标统一类别的编码即可，这样可以使图更加简明、清晰。
4．在试验设备上，使用74 LS 08、74 LS 32、74 LS 04集成电路连接、调试和测试余3码转换成2421 BCD 码电路时，每连一根线都在本子上几下其线脚在实验板上的位置及标明其表示的意思。这样才能有序地进行实验（如图1-16）。
图1-15 逻辑电路线路连接（右图正常显示，输入“0111”，输出“0100”；
左图不是正常显示，输入“0111”，输出却是“0110”）
5、通过此课程设计，更加加深了对数字逻辑这门课程的理解，了解了其重要性。
图1-16 对总结第4点举例
本科生课程设计成绩评定表
班级：计算机0902班姓名：许玉林学号：0120910340213
及格（60-69分）、60分以下为不及格
指导教师签名：
时间：2011年1月1日