《数字集成电路》期末考试卷A(含问题详解)
《数字集成电路》期末试卷(含答案)
浙江工业大学 / 学年第一学期 《数字电路和数字逻辑》期终考试试卷 A姓名 学号 班级 任课教师一、填空题（本大题共10小题，每空格1分，共10分）请在每小题的空格中填上正确答案。
错填、不填均无分。
1．十进制数（68）10对应的二进制数等于 ；2．描述组合逻辑电路逻辑功能的方法有真值表、逻辑函数、卡诺图、逻辑电路图、波形图和硬件描述语言（HDL ）法等，其中 描述法是基础且最直接。
3．1A ⊕可以简化为 。
4．图1所示逻辑电路对应的逻辑函数L 等于 。
A B L≥1&CYC图1 图25．如图2所示，当输入C 是（高电平，低电平） 时，AB Y =。
6．两输入端TTL 与非门的输出逻辑函数AB Z =，当A =B =1时，输出低电平且V Z =0.3V ，当该与非门加上负载后，输出电压将(增大，减小) 。
7．Moore 型时序电路和Mealy 型时序电路相比， 型电路的抗干扰能力更强。
8．与同步时序电路相比，异步时序电路的最大缺陷是会产生 状态。
9．JK 触发器的功能有置0、置1、保持和 。
10．现有容量为210×4位的SRAM2114，若要将其容量扩展成211×8位，则需要 片这样的RAM 。
二、选择题（本大题共10小题，每小题2分，共20分）在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。
错选、多选或未选均无分。
11．十进制数（172）10对应的8421BCD 编码是 。
【 】A ．（1111010）8421BCDB ．（10111010）8421BCDC ．（000101110010）8421BCD D ．（101110010）8421BCD12．逻辑函数AC B A C B A Z +=),,(包含 个最小项。
【 】A ．2B ．3C ．4D ．513．设标准TTL 与非门AB Z =的电源电压是+5V ，不带负载时输出高电平电压值等于+3.6V ，输出低电平电压值等于0.3V 。
数字电路期末试题及答案
数字电路期末试题及答案1. 选择题（每题2分，共30题，总分60分）(1) 以下哪种逻辑门的输出为低电平时，输入端需全为高电平？A. 与门B. 或门C. 非门D. 异或门答案：C(2) 下列选项中，哪个是数码管的常见类型？A. BCD码B. 七段码C. 格雷码D. 码编码答案：B(3) 在数字电路中，把输入引脚作为输出引脚使用的器件是？A. 复用器B. 反相器C. 编码器D. 解码器答案：D(4) 单位延时器可用于延时输入信号，它的作用是？A. 放大延时信号B. 过滤延时信号C. 产生延时信号D. 编码延时信号答案：C(5) 下面哪个是D触发器的输出特性？A. 同步输出B. 反转输出C. 清零输出D. 使能输出答案：B(6) 在四位二进制加法器电路中，超过位数范围的进位称为？A. 高位进位B. 低位进位C. 溢出进位D. 数据进位答案：C...2. 填空题（每空2分，共10空，总分20分）(1) 由三个反相器构成的分频电路称为_______。
答案：三分频(2) 一个四位二进制数可以表示_______个不同的状态。
答案：16...3. 简答题（每题10分，共6题，总分60分）(1) 请简要说明译码器（Decoder）的工作原理及其应用场景。
答案：译码器是一种组合逻辑电路，用于将输入的编码信号转换为输出的解码信号。
它根据特定的逻辑关系来解码输入信号，并且只有一个输出端口被激活，其他输出均为低电平。
常见的应用场景包括数码管显示、地址解码、信号传递等。
(2) 请简要说明触发器（Flip-flop）的工作原理以及它与时序电路的关系。
答案：触发器是一种存储器件，用于在时序电路中存储和传输信息。
它有两个稳定的输出状态，分别称为"Set"和"Reset"。
触发器能够根据控制信号的变化来决定是否改变输出状态，从而实现信息的存储和传输。
触发器在时序电路中起着重要的作用，用于实现存储、计数和时序控制等功能。
《数字集成电路》期末试卷B(含答案)
浙江工业大学 / 学年第一学期 《数字电路和数字逻辑》期终考试试卷B姓名 学号 班级 任课教师一、填空题（本大题共10小题，每空格1分，共10分）请在每小题的空格中填上正确答案。
错填、不填均无分。
1．（1011111．01）2=（ ）102．若10010110是82421BCD 码的一组代码，则它对应的十进制数是________。
3．逻辑函数B A AB F +=的反函数F =________。
4．不会出现的变量取值所对应的最小项叫做 。
5．组合逻辑电路任何时刻的稳定输出仅仅只决定于__________各个输入变量的取值。
6．描述时序逻辑电路的逻辑表达式有驱动方程、________________和输出方程。
7．1K ×4位ROM ，有 位地址输入。
8．要把模拟量转化成数字量一般要经过四个步骤，分别称为采样、保持、________、编码。
9．D/A 转换器的主要参数有 、转换时间和转换精度。
10．集成单稳态触发电路的暂稳态维持时间取决于 。
二、选择题（本大题共10小题，每小题2分，共20分）在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。
错选、多选或未选均无分。
11．若已知Y XY YZ Z Y XY +=++，判断等式=+++))()((Z Y Z Y Y X Y Y X )(+成立的最简单方法是依据 规则。
【 】A ．代入规则B ．对偶规则C ．反演规则D ．互补规则12．F (A ,B ,C )的任意两个最小项之积等于 。
【 】 A ．0 B ．1 C ．ABC D ．ABC13．+0+1A A A ⋅⋅等于 。
【 】 A ．0 B ．1 C ． A D ．A 14．将TTL 与非门正常使用时，多余的输入端应 。
【 】 A ．全部接高电平 B ．部分接高电平，部分接地 C ．全部接地 D ．部分接地，部分悬空 15． S R 触发器不具有 功能。
2011年数字集成电路设计期末考试试卷_中国科技大学
Digital Integrated CircuitsFinal Exam, Fall 2011School of Software EngineeringUniversity of Science and Technology of China(19:00pm–21:00 pm November24th, 2011)Name:Student ID:Score:1. Which of the following two circuits is better in terms of speed? Why?(5 points)2. Describe at least two methods to reduce power dissipation of digital integrated circuits. (5 points)3. What are the advantage and disadvantage of using the transistor M r in the figure below? (4 points)4.Reconstruct the following circuit logically to avoid glitches.Describe at least one other method to avoid glitches. (5 points)5.Sketch a transistor-level circuit for a 6-Transistor SRAM. Describe how to size transistors to ensure writing reliability and reading stability.What is the purpose of having PMOS transistors? (10 points)6.Consider a 24-bit, 6 stage carry-bypass adder with the following delays: t setup=4, t carry=1, t sum=4, t bypass=2.b) Consider the setup delay and carry propagation of the2nd, 3rd, and 4th stages.It is not on the critical path and can be made slower without affecting performance. If each stage is allowed to handle a different number of bits,how many bits would you assign to each of the first four stages to minimize the delay from inputs to the carry outputfor the first16 bits of the adder?(6 points)c)Given the condition that the number of bits in the last two stages is 8, how many bits would you assign to each of the last two stages to minimize the delay of the adder?(4 points)7. Assume the registers in the following figure are edge triggered with t clk-q, max= 4ns, t clk-q, min = 2ns, t setup = 1ns, and t hold= 1ns:CLK(a) What is the maximum operating frequency of this system if there is no skew and jitter? (8 points)(b) What is the maximum random clock skew that this system can tolerate? (6 points)8.Throughout this problem assume that the drain capacitance in the following figure,C D = 0.a) Assuming P(A=0）= P(B=0) = P(C=0) = P(D=0)=0.5, what are the activity factors (i.e.,α0→1) at each of the nodes n0– n3?(6 points)b) Assuming the circuit operates with a supply voltage V DD and a clock frequency f, what is the total dynamic power consumed by this circuit as a function of Cin, C1, C2, and C L (as labeled above)? Note that you should include the power dissipated by driving the A, B, C, and D inputs.(7 points)c)Using the method of logical effort, calculate the delay from A to n2 ((in units of t inv) as a function of Cin, C1, C2, and CL.(5 points)9. Sketch a transistor-level circuit for a master-slave positive edge-triggered register which consists of transmission gates. Express t setup and t hold in terms of t pd_inv(the delay of an inverter) and t pd_tx (the delay of a transmission gate). (7 points）10.What is the logic function performed by this circuit? What is the purpose of having the transistor M1? (4 points)11. Assume that the threshold voltage of NMOS transistors V TN = 0.4V. Calculate the voltage of nodes A and B respectively? (4 points)12.Consider the figure below. During the precharge phase, the output node is precharged to V DD. Assume that all inputs are set to zeros during precharge, and that the capacitance C a is discharged。
数电期末考试试卷及答案
一．填空题（1分/空，共24分）1)十进制数(99.375)10＝（1100011.011）2＝（63.6）16。
2)数字电路按照其结构和工作原理分为两大类：组合逻辑电路和时序逻辑电路。
3)以下类型门电路多余的输入端应如何处理：TTL 与非门：接高电平或者悬空或者并联，CMOS 与非门：接高电平或者并联。
4）逻辑函数Y=AB+BC+CA 的与非-与非式为((AB)’(BC)’(CA)’)’。
5)三态输出门在普通门电路输出状态的基础上增加的状态为__高阻态___。
6)TTL 反相器的阈值电压为V TH =1.4V 。
若CMOS 反向器的V DD =10V 则其阈值电压为V TH =5V。
7)RS 触发器的特性方程为：Q*=S+R’Q ，(约束条件：SR=0)，T 触发器的特性方程为：Q*=T’Q+TQ’。
8)16选1数据选择器的地址端有4位，n 个触发器构成计数器的最大计数长度为2n 。
9)如图(1-1)所示触发器电路中，当A=1时，输出状态为____Q=1___，如图（1-2）所示计数器电路为___6___进制计数器。
10）触发器三种触发方式分别为：电平触发，脉冲触发（主从触发），边沿触发，其中边沿触发的触发器抗干扰能力最强。
11）在多谐振荡器，单稳态触发器，施密特触发器中，施密特触发器中常用于波形的变换和整形，单稳态触发器常用于定时及延时，多谐振荡器常用于产生脉冲波形。
图（1-3）中555定时器接成的是施密特触发器。
√二.将下列逻辑函数化简为最简与-或形式(方法不限)(每小题5分,共15分，按步骤酌情给分)1）CDACD ABC AC Y +++=''2）求Y=BC AC C A B A +++))'')('((的反函数并化简=AC’+C(AB+AD’+D)Y’=[(A’B+AC’)’+(A’+C’)](B’+C’)=AC’+C(A+D)=[(A+B’)(A’+C)+A’+C’](B’+C’)=AC’+AC+CD =(AC+A’B’+B’C+A’+C’)(B’+C’)=A+CD=B’+C’3）356710(,,,)(,,,,)Y A B C D m m m m m =∑，给定约束条件：012480m m m m m ++++=。
数字集成电路模拟集成电路考试题库
1、在数字集成电路中，以下哪个元件常用于存储二进制信息？A、电阻B、电容C、触发器D、电感（答案：C）2、模拟集成电路中，用于放大电信号的主要元件是？A、二极管B、晶体管C、电阻D、电容（答案：B）3、以下哪种逻辑门电路可以实现“与”运算？A、NOT门B、OR门C、AND门D、XOR门（答案：C）4、在数字电路中，时钟信号的主要作用是？A、提供电源B、控制信号同步C、放大信号D、转换信号格式（答案：B）5、模拟集成电路中，常用于稳定输出电压的元件是？A、运算放大器B、比较器C、稳压二极管D、晶体管（答案：C）6、数字集成电路中，D触发器的输出在何时更新？A、时钟信号上升沿B、时钟信号下降沿C、随时更新D、根据输入信号变化（答案：A，注：也可能是B，具体取决于触发器类型，但此题通常按常见上升沿触发考虑）7、以下哪种电路常用于将模拟信号转换为数字信号？A、放大器B、滤波器C、模数转换器（ADC）D、数模转换器（DAC）（答案：C）8、在模拟集成电路中，用于产生稳定电流源的元件或电路是？A、电流镜B、电压源C、电阻网络D、电容器（答案：A）9、数字集成电路中，用于实现计数功能的电路是？A、加法器B、寄存器C、计数器D、译码器（答案：C）10、以下哪种电路或元件在模拟集成电路中常用于信号的滤波？A、放大器B、比较器C、滤波器D、振荡器（答案：C）。
数字电路期末复习试题和答案解析(20201128145041)
数字电路期末复习题及答案一、填空题1数字信号的特点是在时间上和幅值上都是断续变化的,其高电平和低电平常用1 _ 和_0 ___ 来表示。
2、分析数字电路的主要工具是逻辑代数，数字电路又称作逻辑电路。
3、逻辑代数又称为布尔代数。
最基本的逻辑关系有与、或、非三种。
常用的几种导出的逻辑运算为与非或非与或非同或异或。
4、逻辑函数的常用表示方法有逻辑表达式真值表逻辑图。
5、逻辑函数F=A BCD +A+B+C+ __________ 。
6、逻辑函数F=A B A B A B AB = ________ 0 _______ 。
7、OC门称为集电极开路门，多个OC门输出端并联到一起可实现丄与功能。
8、TTL与非门电压传输特性曲线分为饱和区、转折区、线性区、截止区。
9、触发器有2 个稳态，存储8位二进制信息要__8 ________________________个触发器。
1 0、一个基本RS触发器在正常工作时，它的约束条件是R+S=1，则它不允许输入S = 0且R= 0的信号。
11、一个基本RS触发器在正常工作时，不允许输入R=S= 1的信号，因此它的约束条件是RS=0 。
1 2、在一个CP脉冲作用下，引起触发器两次或多次翻转的现象称为触发器的空翻，触发方式为主从式或边沿式的触发器不会出现这种现象。
13、施密特触发器具有回差现象，又称电压滞后特性；单稳触发器最重要的参数为脉宽。
14、半导体数码显示器的内部接法有两种形式：共阴接法和共阳接法。
15、对于共阳接法的发光二极管数码显示器，应采用低电平驱动的七段显示译码器。
16、寄存器按照功能不同可分为两类：移位寄存器和数码寄存器。
17、时序逻辑电路按照其触发器是否有统一的时钟控制分为同步时序电路和异步时序电路。
、选择题1 一位十六进制数可以用 C 位一进制数来表示。
A 1B . 2 C.4D162、十进制数25用8421BCD码表示为 B 。
A 10 101B . 0010 0101 C.100101 D .101013、以下表达式中符合逻辑运算法则的是D。
数字电路与系统期末题及答案两套2009-2011年。30P
《考研专业课高分资料》大连理工大学《数字电路与系统》期末题北京总部考研专业课教研中心《考研专业课高分资料》之期末题細:餓+期末试题 (3)大连理工大学2010—2011学年寃1学期期末考试 ................ : . (3)(A) .................................... : (3)数字电路与系_试试题(A)参考答案 (12)人-连理工大学2009—2010学年第1学期期末考试 (17)(A) (17)者萨培避与襄^试试题(A)参考答案 (26)3/29 . . • •• - • -考研专业课研发中心:第四模块期末试题I ■I I I \I i 大连理工大学2010-2011学年第1学期期末考试I 1 I ti 龄猶絲鑛试试题(A )I 1 I：所有答案必须做在答案题纸上，做在试题纸上无效！以下各题，皆只有一个答案是正确的，请选择：(1分*10)1.下图是某一逻辑门的内部结构图，请固答：+5VV(1) .若输入信号X=1且¥=0,则输出信号Z 应为 ：A ： 1. B: 0C:.不确定 D ：皆有可能’(2) .该逻辑门电路的逻辑符号为■:A: - B ：CO-D ：与)(3) .在正逻辑体制下，孩.逻辑门的等效逻辑符号为：：上二ID-c ；-D ：-I I■'2.请完成以下计窣制的转换：58in =A ： 00101011B ； 01011010C ： 00111011D ： 0.0111010 3. 请完.成以下分数制的转换：10110010，= ■■ ，/- -'• ■ - -八：By B: A2 C： Al D： Bli- : m负載的CMOS反相器（即非门），若萬输入逻辑值为1,则其输出逻辑值为」A: 1 B：0 C：不确定 D：皆有可能扬出端有电流流入，请问：该电流是::；-■, ■：.B：灌电流i-；l ii:； iii 力 - ________ :...B:负值5 - ■：'■! b门屯路如下所示，则输出信号F= _________________________■；. 4电路和组合逻辑电路在功能上有何区别？1任意吋刻输出状态是否跟输入信号作用前的状态有关仃无输出信号::.勹令’（！分45）1-矿幵关代数（也称为布尔代数）中1 + 1=2.利周反演规则（也称为德•摩根定理），写出逻函数F=Y J- Z+X'' Y的反函数为（无需化简）：F, =3:将逻辑函数G=X -Y+Y -Z+X *Z改写为最小项之和的形式：F=S X.Y.Z（）和最大项之积的形式：F=JI». t. “ ）4.在四变量的卡诺图中，W-X* ^Y*Z的四个相邻项为：5.写出以下电路的输出表达式:Fl= 、F2= 、F3=6.J -K 触发器的特性方程为： D 触发器的特性方程为：若使用D 触发器来设计一个模为十的计数器，请问至少需要几个D 触发器？7.利用卡诺图化简函数的结果是不是唯一的？三.某一逻辑函数 F=2,.I .r.z （ 2, 3,6, 7, 9,-12,13）,回答问题（5 分*2）: 1.画出该函数的卡诺图，并将菡数值填入该卡诺图：......2. 宣接在上面的卡诺图中，将可以合并的1单元圈起来，并写出该函数的最简与或式:四.集成电'路74X139包含两个二线至四线的译码器，其逻辑符号如下图所示，请回答以下问题（3分*5〉:1，.74X139中的两个二线至'四线译码德若要IE 常译码，其使能控制端EN_L 的有效逻辑值应为什么？ ++ . - . 5/2?；' 、‘.• 考研专业澡研发中心F2X O T1 FiEN A BENLL -L -LL-L-L-L74X139刊奶幻妁罚们72736/291ENABCID0IDIID2D3D4D5D6D7考研专业课研发中心所奋输出端的有效电平为高电平还是低电平？JiivoZ间是何种逻辑关系？i：出苏中一个输出端Y3.L的逻辑表达式:也•• •A 74X139组成的电路如图所示，请写出输出端F的表达式:五，集成电路74X151是一个八选一的数椐选择器，其中C、B、A是3位选择变量，DO〜D7是八个数据输入端I £11.是低电平有效的使能控制端，请回答以下问题（共10分）：74X151,0 ---------- ----- 9-1.在实噓屮，若使74X151正常工作，实现其数据选择的功能，使能端EN_L应如何连线？请直接在上图 f涵出（2分），2.请根据上图填写下面的数据选择表（8分）:六.某一同步时序逻辑电路如下图所示（5分*3〉:1.请写出各触发器的激励方程（也称为存储器的输入方程）：- Dl-= •- . • •.，曇“•. L F L•-.考研专业课研发中心《考研专业课高分资料3之期末题谞•^出该电路的次态方程（也称为状态方程）:01 =调的输出方程:;）UT:-i::::组方程填写状态转换表:3.请究成该屯路的状态图，并标注状态转换时的输入输出值（X/OUT）：《考研专业锞髙分资料》之期末题七.7虹163是集成的四位计数器电路，其组成的不足模计数电路如下图所示（10分h74X163->C3X <2 CLR ■o LD -ENP —ENTQAQB QC QD RCO1. •请画出该计 环图（7分乂2.该计数器电路是模几的计数器？（3分）Vcc=+5Vj — 数电路的状态循《考研专业课高分资料》之期末题A.在举重比赛中，有A、B、C三名裁判，其中A为主裁判，当两名或者两名以上裁判（且必须包括A在上举合格后，才可发出合格信号,请按照以下步骤实现丄述要求的逻辑电路（15分）。
数字集成电路第二版答案
数字集成电路第二版答案【篇一：《数字集成电路》期末试卷a(含答案)】考试试卷 a姓名学号班级任课教师一、填空题（本大题共10小题，每空格1分，共10分）请在每小题的空格中填上正确答案。
错填、不填均无分。
1．十进制数（68）10对应的二进制数等于；2．描述组合逻辑电路逻辑功能的方法有真值表、逻辑函数、卡诺图、逻辑电路图、波形图和硬件描述语言（hdl）法等，其中描述法是基础且最直接。
3．a?1可以简化为4．图1所示逻辑电路对应的逻辑函数l等于。
abc≥1lcy图1图25．如图2所示，当输入c是（高电平，低电平）时，y?ab。
6．两输入端ttl与非门的输出逻辑函数z?ab，当a=b=1时，输出低电平且vz=0.3v，当该与非门加上负载后，输出电压将(增大，减小)。
7．moore型时序电路和mealy型时序电路相比，型电路的抗干扰能力更强。
8．与同步时序电路相比，异步时序电路的最大缺陷是会产生 9．jk触发器的功能有置0、置1、保持和的ram。
二、选择题（本大题共10小题，每小题2分，共20分）在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。
错选、多选或未选均无分。
11．十进制数（172）10对应的8421bcd编码是。
【】a．（1111010）8421bcdb．（10111010）8421bcdc．（000101110010）8421bcd d．（101110010）8421bcd12．逻辑函数z(a,b,c)?ab?ac包含【】a．2 b．3c．4d．513．设标准ttl与非门z?ab的电源电压是+5v，不带负载时输出高电平电压值等于+3.6v，输出低电平电压值等于0.3v。
当输入端a、b电压值va=0.3v，vb=3.6v和va=vb=3.6v两种情况下，输出电压值vz分别为。
a．5v，5v c．3.6v，0.3v【】b．3.6v，3.6v d．0.3v ，3.6v14．图3所示电路的输出逻辑函数z1等于。
306数字电路结业A答案
四川邮电职业技术学院 2006－2007学年第二学期期末考试306级通信类专业各班《数字电子技术》试卷（A 套）(闭卷)(参考答案及评分标准)1．A 2．A 3．A 4．C 5．C三、（10分）1．反函数Y=AB (A + B)，Y=A+B+AB （2分）对偶函数Y =A+B AB '+（2分）2．Y=AB+AB (3分)3．逻辑电路图为：（3分）A B B A四、（10分）1．解：Ｙ的卡诺图为B所以Y （A 、B 、C 、D ）=B （6分）评分标准：填卡诺图2分；画圈2分；写表达式2分2．解：Ｙ（A 、B 、C 、D ）=C+AB （4分）评分标准：画圈2分；写表达式2分 五、（5分）状态转换图为：（3分）所以该计数器为六进制计数器。
（2分） 六、（６分）解：由图有Q n+1=D=n Q （2分）所以Ｑ的波形为（设初态为0）：（4分）CP Q评分说明：可以不写表达式，直接画波形，只要波形正确，给满分。
七、设计题（28分）1．（6分）解：电路图为：（3分）状态转换图为： （3分）2．（22分）（1）解： ① 分析题意列真值表。
（2分）A B C图12-19 例12-2电路图C A② 由真值表写出逻辑函数式。
（2分） Y = A BC + A B C + AB C + ABC ③ 化简（3分）Y = A BC + A B C + AB C + ABC= BC(A + A)+ AC(B +B) + AB C = BC + AC + AB C = AC + B(C + A ) = AC + BC + AB =AC+BC+AB=ACBCAB④ 画逻辑电路图。
（3分）（2）用74LS138和门电路实现（6分） 解：由（1）中真值表可知： Y = A BC + A B C + AB + ABC＝m 3＋m 5＋m 6＋m 7 ＝3567m m m m所以只要令74LS138的输入A 2、A 1、A 0分别代表输入变量A 、B 、C ，那么Y ＝3567m m m m＝3567Y Y Y Y （3分）所以逻辑电路图为：（3分）（3） 用74LS151实现（6分）解：令输入变量A 、B 、C 分别对应74LS151的数据选择端A 2、A 1、A 0，则74LS151的输出Y ＝0011223344556677D D D D D D D D m m m m m m m m +++++++由（1）中真值表可知： Y = A BC + A B C + AB C + ABC＝m 3＋m 5＋m 6＋m 7所以只要令74LS151的数据输入端分别为D 2＝D 1＝D 0＝D 4＝0，D 3＝D 5＝D 6＝D 7＝1，那么就可以用74LS151实现。
数电复习资料(含答案)
数电期末考试复习题（习题册）（含答案）第一章（选择、判断共20题）一、选择题1．以下代码中为无权码的为。
A. 8421BCD码B. 5421BCD码C.余三码D.格雷码2．以下代码中为恒权码的为。
A.8421BCD码B. 5421BCD码C.余三码D.格雷码3．一位十六进制数可以用位二进制数来表示。
A.１B.２C.４D. 164．十进制数25用8421BCD码表示为。
A.10 101B.0010 0101C.100101D.101015．在一个8位的存储单元中，能够存储的最大无符号整数是。
A.（256）10B.（127）10C.（FF）16D.（255）106．与十进制数（53.5）10等值的数或代码为。
A.(01010011.0101)8421BCDB.(35.8)16C.(110101.1)2D.(65.4)87．矩形脉冲信号的参数有。
A.周期B.占空比C.脉宽D.扫描期8．与八进制数(47.3)8等值的数为：A. (100111.011)2B.(27.6)16C.(27.3 )16D. (100111.11)29.常用的B C D码有。
A.奇偶校验码B.格雷码C.8421码D.余三码10．与模拟电路相比，数字电路主要的优点有。
A.容易设计B.通用性强C.保密性好D.抗干扰能力强二、判断题（正确打√，错误的打×）1. 方波的占空比为0.5。
（）2. 8421码1001比0001大。
（）3. 数字电路中用“1”和“0”分别表示两种状态,二者无大小之分。
（）4．格雷码具有任何相邻码只有一位码元不同的特性。
（）5．八进制数（18）8比十进制数（18）10小。
（）6．当传送十进制数5时，在8421奇校验码的校验位上值应为1。
（）7．在时间和幅度上都断续变化的信号是数字信号，语音信号不是数字信号。
（）8．占空比的公式为：q = t w / T，则周期T越大占空比q越小。
（）9．十进制数（9）10比十六进制数（9）16小。
数字集成电路试题及答案
北京大学信息学院考试试卷考试科目： 数字集成电路原理 考试时间 姓名： 学号：题 号 一 二三四五六七八九 十总分分 数 阅卷人以下为答题纸，共 6 页一、填空1、（4分）CMOS 逻辑电路中NMOS 管是（ 增强 ）型，PMOS 管是（增强）型； NMOS 管的体端接（ 地 ），PMOS 管的体端接（ VDD ）。
2、（8分）CMOS 逻辑电路的功耗由3部分组成，分别是（ 动态功耗 ）、（开关过程中的短路功耗）和（ 静态功耗 ）；增大器件的阈值 电压有利于减小（ 短路功耗和静态 ）功耗。
3、（6分）饱和负载NMOS 反相器的3个主要缺点是：（ 输出高电平有阈值损失 ）,( 输出低电平不是0，与比例因子Kr 相关 ), ( 输出低电平时有静态功耗 ) 。
4、（3分）三态输出电路的3种输出状态是：（ 高电平 ）， （ 低电平 ）和（ 高阻态 ）。
二、（12分）画出实现ABC D C B A Y +++=)(的静态CMOS 电路，如果所有MOS管的导电因子都是K ,分析几个输入同步变化的等效反相器的导电因子（K Neff 和K Peff ），在什么输入状态下电路有最小的低电平噪声容限。
Kneff = 1/(1/3k + 1/k) + k/3 = 3k/4 + k/3 = （13/12）K;Kpeff = 1/(1/3k + 1/k) + k/3 = （13/12）K;当 D = 1 ，A、B、C 同步变化时，上拉通路3个串联的PMOS 管起作用，下拉支路所有NMOS 都起作用，Kneff 最大 ， Kpeff 最小，传输特性曲线在最左边。
三、（12分）分析下面2个电路的逻辑功能，若所有输入高电平都是5V、输入低电平都是0V，电源电压是5V，所有MOS 管的阈值电压绝对值都是0.8V，分析2个电路的输出高、低电平和主要优缺点。
（1） （2） 电路 1） ⎩⎨⎧=======+=VB A VB A Vol B A AB Y 2.4Voh 15Voh 0,0,时，时， ，电路 2） B A B A B A AB Y +=++=，低电平0V ，高电平 4.2V 电路1）结构简单，节省面积，逻辑电平与输入状态相关，驱动能力差，噪声容限小。
《数字集成电路》期末试卷A(含答案)
浙江工业大学 / 学年第一学期 《数字电路和数字逻辑》期终考试试卷 A姓名 学号 班级 任课教师一、填空题（本大题共10小题，每空格1分，共10分）请在每小题的空格中填上正确答案。
错填、不填均无分。
1．十进制数（68）10对应的二进制数等于 ；2．描述组合逻辑电路逻辑功能的方法有真值表、逻辑函数、卡诺图、逻辑电路图、波形图和硬件描述语言（HDL ）法等，其中 描述法是基础且最直接。
3．1A⊕可以简化为 。
4．图1所示逻辑电路对应的逻辑函数L 等于 。
A B L≥1&CYC图1 图25．如图2所示，当输入C 是（高电平，低电平） 时，AB Y =。
6．两输入端TTL 与非门的输出逻辑函数AB Z =，当A =B =1时，输出低电平且V Z =0.3V ，当该与非门加上负载后，输出电压将(增大，减小) 。
7．Moore 型时序电路和Mealy 型时序电路相比， 型电路的抗干扰能力更强。
8．与同步时序电路相比，异步时序电路的最大缺陷是会产生 状态。
9．JK 触发器的功能有置0、置1、保持和 。
10．现有容量为210×4位的SRAM2114，若要将其容量扩展成211×8位，则需要 片这样的RAM 。
二、选择题（本大题共10小题，每小题2分，共20分）在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。
错选、多选或未选均无分。
11．十进制数（172）10对应的8421BCD 编码是 。
【 】A ．（1111010）8421BCDB ．（10111010）8421BCDC ．（000101110010）8421BCD D ．（101110010）8421BCD12．逻辑函数AC B A C B A Z +=),,(包含 个最小项。
【 】A ．2B ．3C ．4D ．513．设标准TTL 与非门AB Z =的电源电压是+5V ，不带负载时输出高电平电压值等于+3.6V ，输出低电平电压值等于0.3V 。
2007-2008学年第2学期《数字电路》期末考试试卷（闭卷A）
2007-2008学年第2学期《数字电路》期末考试试卷（闭卷A）我以⼀名⼤学⽣的⼈格尊严保证，在本场考试中，⾃觉遵守考试纪律，服从考试管理，决不作弊或帮助别⼈作弊！签名：学院专业学号级班··················密···················封·····················线··················命题⼈签字：系主任签字：审核院长签字：共印份数：第1页共4页聊城⼤学计算机学院07—08学年第2学期期末考试2007级《数字电路》试题（闭卷 A卷）⼀、填空题（每空1分，共20分）8421BCD代码为。
2．Y=A(B+C)+CD的对偶式Y D＝。
3．常⽤的逻辑函数表⽰⽅法主要有、、、波形图、卡诺图和硬件描述语⾔等。
4．逻辑函数Y＝AB＋BC+AC化为与⾮—与⾮形式为。
5．如果以⾼电平表⽰逻辑1，以低电平表⽰逻辑0，则这种表⽰⽅法为。
6．⼏个OD（漏极开路输出）门的输出直接相连，可以实现逻辑。
7．CMOS电路最突出的⼀⼤优点是。
数电期末试卷与答案(共4套)
XX大学信息院《数字电子技术基础》期终考试试题（ 110 分钟） (第一套 )一、填空题：（每空 1 分，共 15 分）1．逻辑函数YABC 的两种标准形式分别为（）、（）。
2．将 2004 个“ 1”异或起来得到的结果是（）。
3 ．半导体存储器的结构主要包含三个部分，分别是（）、（）、（）。
4．8 位 D/A 转换器当输入数字量10000000 为 5v。
若只有最低位为高电平，则输出电压为（） v；当输入为 10001000，则输出电压为（）v。
5．就逐次逼近型和双积分型两种A/D 转换器而言，（）的抗干扰能力强，（）的转换速度快。
6．由 555 定时器构成的三种电路中，（）和（）是脉冲的整形电路。
7．与 PAL 相比，GAL 器件有可编程的输出结构，它是通过对（）进行编程设定其（）的工作模式来实现的，而且由于采用了（）的工艺结构，可以重复编程，使它的通用性很好，使用更为方便灵活。
二、根据要求作题：（共 15 分）1．将逻辑函数P=AB+AC 写成“与或非”表达式，并用“集电极开路与非门”来实现。
2．图 1、2 中电路均由 CMOS 门电路构成，写出 P、Q 的表达式，并画出对应 A 、B、C 的 P、Q 波形。
三、分析图 3 所示电路：（10 分）1）试写出 8 选 1 数据选择器的输出函数式；2）画出 A2、 A1、 A0 从 000~111连续变化时， Y 的波形图；3）说明电路的逻辑功能。
四、设计“一位十进制数”的四舍五入电路（采用8421BCD 码）。
要求只设定一个输出，并画出用最少“与非门”实现的逻辑电路图。
（15 分）五、已知电路及、4(a) (b)所示，设触发器的初态均为“ 0”，试CP A 的波形如图画出输出端 B 和 C 的波形。
（8 分）BC六、用 T 触发器和异或门构成的某种电路如图5(a)所示，在示波器上观察到波形如图 5(b)所示。
试问该电路是如何连接的？请在原图上画出正确的连接图，并标明 T 的取值。
数字集成电路期末考试卷B-2012
第 2 页 共 2页
图1
第 1 页 共 2页
2.
在CMOS 0.18um工艺模型中，一个nFET的W=9um，L=0.18um，其工艺互导为k′n=90uA/V2， VTn=0.45V。假设Vsb=0。 （每小题5分，n=2.0V 时的 MOS 管导通电阻。 （2）计算电压设定为 VGSn=2.0V，VDSn=1.1V 时的 MOS 管导通电阻。
kn 。 = 1.5 三输入的或非门 y = a + b + c 的逻辑努力是（ 12 ） kp
6．工艺的氧化层厚度 tox=10 nm ( ε ox = 3.453 × 10−13 F/cm)，载流子迁移率为µn=520 cm2 / (V· s) , µp= 260 cm2 / (V· s)，若一个 nFET 和 pFET，W=16µm，L= 0.5µm，栅电压 VG=4V，而阈值电 压 VTn=0.8V，VTp= − 1V, 则 Rn=（ 13 ）; Rp=（ 14 ）; 若保持 nFET 尺寸不变 而增加 pFET 的宽度，使 Rp = 0.8Rn， pFET 的宽度 W=（ 15 ). 二、问答题（15%） （1）MOS管的窄沟道效应和短沟道效应的定义分别是什么？ （2）动态 CMOS 逻辑电路的定义是什么？ （3）闩锁效应的形成原因及其预防措施？ 三、综合题（55%） 1. 图1为阻性负载的反相器电路。电源电压VDD为5V，MOS管的工艺互导为20uA/V2，阈值电 压为0.8V，负载电阻RL为200K，W/L=2。计算该反相器的传输特性数值（VIL，VOL，VIH， VOH）及电路的噪声容限，并在此基础上评价该反相器的设计是否最优。 （11分）
华
日
侨
大
学
数字集成电路设计
苏教版(2019) 选择性必修1 课时4 数字集成电路 练习(含答案)
课时4数字集成电路一、基础巩固篇1.下列对于MOS管的描述，不恰当．．．的是()A.MOS管属于电压控制元件B.栅极G用来控制导通与截止C.漏极D通常接地D.MOS管作为开关时工作在截止与导通状态2.数字集成电路有多种类型，最常用的有TTL和CMOS两种，它们各有优缺点，适用于不同的场合中。
下列不是．．TTL电路优点的是()A.速度快B.允许负载流过的电流较大C.抗静电能力强D.功耗小3.下列有关如图所示的数字集成电路芯片的说法中，正确的是()A.该芯片的名称是双4输入与门B.7脚接电源正极，14脚接地C.该芯片能实现或逻辑关系D.如果工作的电压为12 V，则该芯片为CMOS型电路4.如图所示是CT74LSO4集成芯片引脚图，共有____个门电路，每个门电路有____个输入端、____个输出端。
横线上分别应该填()A.6、6、6B.6、1、1C.1、6、6D.1、1、15.晶体管电路如图所示，请完成以下任务：(1)三极管型号是________(在①NPN型；②PNP型中选择合适的选项，将序号填写在“______”处)；(2)将开关断开，LED1和LED2分别为________和________(在①熄灭；②点亮中选择合适的选项，将序号填写在“________”处)；将开关闭合，LED1和LED2分别为______和______(在①熄灭；②点亮中选择合适的选项，将序号填写在“______”处)；(3)开关闭合时，三极管基极和发射极之间的电压为__________ V，三极管处于__________状态(在①饱和；②截止中选择合适的选项，将序号填写在“________”处)；集电极和发射极之间________(在①导通；②截止中选择合适的选项，将序号填写在“______”处)，LED2被________(在①短路；②开路中选择合适的选项，将序号填写在“______”处)。
二、素养提升篇1.如图所示是数字集成电路CC4001引脚排列及功能图，在实际使用中，下列说法中不正确．．．的是()A.该集成电路是TTL类型B.如果电路中只需用一个或非门，可任选其中一组C.把其中一组或非门的两个输入端并接后，可以实现非门的功能D.把该集成块中的或非门加以组合，可以实现与门功能2.如图所示的集成逻辑门电路引脚图(V CC＝5 V)，关于该电路描述错误．．的是()A.该集成电路属于TTL类型B.该集成电路的名称为四2输入与非门C.该集成电路由普通晶体三极管构成D.该集成电路的四个与非门作用各不相同3.如图a所示为小明设计的湿度警示实验电路，R S为负系数湿敏电阻，电路中所用芯片为四2输入与非门74LS00。
数字集成电路期末考试复习考试试题
数字集成电路复习 前言：看完后一定要自己默写一遍一. 确定组合逻辑延时最小时的尺寸？page186反相器：1，三输入与非门：5/3，二输入与非门：5/3输出负载是一个电容，其电容为第一级（最小尺寸的反相器）输入电容的5倍，因此该电路的等效扇出为1/5L g F C C ==二.用图解的方法得到电压传输特性曲线求解图中门的阈值电压V TN？三. 一个ＰＭＯＳ管的阈值电压为－０．４Ｖ，计算ＶＳＢ＝２．５Ｖ，20.6TV Φ=−时的阈值电压？Page64四. 绘制ＣＭＯＳ反相器的版图？五.一个ＣＭＯＳ反相器，Ｋr＝１,ＶＤＤ＝５Ｖ,ＶＴＮ＝０.８Ｖ,ＶＴＰ＝－１Ｖ，Ｃｏｘ＝４Ｆ／ｃｍ２，ｕｎ＝５００ｃｍ２／Ｖｓ，ｕｐ＝２００ｃｍ２／Ｖｓ．由逻辑阈值点确定的最大噪声容限为多少？六.根据如下的逻辑关系式合成ＣＭＯＳ逻辑门，画出原理图()=+⋅+F D A B C七.看版图，画原理图八.看图４，分别是什么器件，关键尺寸是多少？并写出详细的分析过程？九.补充内容(1).趋肤效应：与频率有关，高频电流倾向于主要在导体的表面流动，其电流密度随进入导体的深度而呈指数下降。
(2).噪声是指在逻辑节点上不希望发生的电压和电流的变化，一个门的稳态参数衡量的该电路对制造过程中发生偏差和噪声干扰的稳定性。
(3).噪声源的类型：与信号摆幅Vsw成正比的噪声。
它对信号节点的影响用gVsw来表示；固定噪声。
它对信号节点的影响等于fVnf,Vnf是噪声源的幅值，而f是从噪声到信号节点的传递函数。
(4).简述ＣＭＯＳ反相器噪声容限的定义：所谓噪声容限，是指电路在噪声干扰下，逻辑关系发生偏离的最大允许值，若输入信号中混入了干扰，当干扰大过反相器输入电压阈值时，则使原本应该是高电平的输出信号转化翻转为低电平，或使原本应该是低电平的输出信号翻转为高电平。
(5).扇入：一个门的扇入定义为该门输入的数目。
扇出：表示连接到驱动门输出端的负载门的数目N，增加一个门的扇出会影响它的逻辑输出电平。
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工业大学 / 学年第一学期
《数字电路和数字逻辑》期终考试试卷 A
学号 班级 任课教师
一、填空题（本大题共10小题，每空格1分，共10分）
请在每小题的空格中填上正确答案。
错填、不填均无分。
1．十进制数（68）10对应的二进制数等于 ；
2．描述组合逻辑电路逻辑功能的方法有真值表、逻辑函数、卡诺图、逻辑电路图、波形图和硬件描述语言（HDL ）法等，其中 描述法是基础且最直接。
3．1
A ⊕可以简化为 。
4．图1所示逻辑电路对应的逻辑函数L 等于 。
A B L
≥1
&
C
Y
C
图1 图2
5．如图2所示，当输入C 是（高电平，低电平） 时，AB Y =。
6．两输入端TTL 与非门的输出逻辑函数AB Z =，当A =B =1时，输出低电平且V Z =0.3V ，当该与非门加上负载后，输出电压将(增大，减小) 。
7．Moore 型时序电路和Mealy 型时序电路相比， 型电路的抗干扰能力更强。
8．与同步时序电路相比，异步时序电路的最大缺陷是会产生 状态。
9．JK 触发器的功能有置0、置1、保持和 。
10．现有容量为210×4位的SRAM2114，若要将其容量扩展成211×8位，则需要 片这样
的RAM 。
二、选择题（本大题共10小题，每小题2分，共20分）
在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号。
错选、多选或未选均无分。
11．十进制数（172）10对应的8421BCD 编码是 。
【 】
A ．（1111010）8421BCD
B ．（10111010）8421BCD
C ．（0）8421BCD
D ．（101110010）8421BCD
12．逻辑函数AC B A C B A Z +=),,(包含 个最小项。
【 】
A ．2
B ．3
C ．4
D ．5
13．设标准TTL 与非门AB Z =的电源电压是+5V ，不带负载时输出高电平电压值等于+3.6V ，输出低电平电压值等于0.3V 。
当输入端A 、B 电压值V A =0.3V ，V B =3.6V 和V A =V B =3.6V 两种情况下，输出电压值V Z 分别为 。
【 】
A ．5V ，5V
B ．3.6V ，3.6V
C ．3.6V ，0.3V
D ．0.3V ，3.6V
14．图3所示电路的输出逻辑函数1Z 等于 。
【 】
A ．ABCD
B ．AB +CD
C ．C
D AB +
D ．CD AB +
A B C D
2-4译码器
Z 1
Z 2
图3 图4
15．图4电路是由二进制译码器组成的逻辑电路，输出Z 2等于 。
【 】
A ．A
B AB ⋅
B ．AB AB +
C ． AB AB +
D ．AB AB ⋅
16．图5所示所示时序电路中，实现n n Q Q =+1 的电路是 。
【
】
CP
CP
CP
A A
B
D
C 图5
17．最能直观反映时序电路状态变化关系的是 【 】
A ．逻辑电路图
B ．时序图
C ．状态真值表
D ．状态转移图 18．可以对脉冲波形整形的电路是（ ）。
【 】
A ．施密特触发器
B ．T 触发器
C ．多谐振荡器
D ．译码器
19．同样分辨率和时钟脉冲下，并行比较型A/D 转换器、逐次逼近型A/D 转换器和双积分
型A/D 转换器中完成一次模数转换时间最长的是 转换器。
【 】 A ．双积分型 B ．逐次逼近型 C ．并行比较型 D ．都一样
20．某十位D/A 转换器满量程输出电压为5.115V ，则当输入D=（010*******）2时，输出
电压为（ ）伏。
【 】 A ．5.115V B ．1.44V C ．2.34V D ．0.44V 三、分析题（本大题共6小题，21-26每小题6分，27小题12分，共48分） 21．已知逻辑函数Z （A ,B ,C ,D ）=∑m （0,2,3,7,8,9）+ ∑d （10,11,12,13,14,15），求逻辑函数
Z 的最简“与或”表达式。
22．分析图6所示电路输出Z 的最简与或逻辑函数表达式。
A
C
B
Z
图6
23．图7是用4选1数据选择器设计的一个逻辑电路，试写出输出逻辑函数Z 的最简与或表达式。
表1 4选1数据选择器功能表
图7
24．设正边沿D 触发器初态为0，试画出图8所示CP 和输入信号作用下触发器Q 端的波形。
CP D Q “1”“0”
图8
25．移位寄存器CC40194功能如表2所示。
设CC40194初态为Q 3Q 2Q 1Q 0＝0000，电路如图9，试画出十个以上CP 脉冲作用下移位寄存器的状态转移图。
图9
表2 CC40194功能表
26．CMOS 集成定时器555组成的电路如图10所示，试问： （1）说出电路的名称；
（2）画出v C 和v O 输出电压波形（设输入v I 低电平宽度足够窄）。
00t
t
v I
v O v I v 0
t
v O
图10
27．已知某同步时序电路如图11所示，试：
（1）分析电路的状态转移图，并要求给出详细分析过程。
（2）电路逻辑功能是什么，能否自启动？
（3）若计数脉冲f CP 频率等于700Hz ，从Q 2端输出时的脉冲频率是多少?
图11
四、设计题（本大题共3小题，第28小题10分，第29小题12分，共22分）
28．如图12所示，为一工业用水容器示意图，图中虚线表示水位，A 、B 、C 电极被水浸没时会有信号输出，试用与非门构成的电路来实现下述控制作用：水面在A 、B 间，为正常状态，亮绿灯G ；水面在B 、C 间或在A 以上为异常状态，点亮黄灯Y ；面在C 以下为危险状态，点亮红灯R 。
要求写出设计过程。
图12
29．某四位二进制加／减计数器的逻辑符号如图13（a ）所示，功能表如表3所示。
（1）用该集成计数器和少量与非门计一个8421BCD 编码的6进制加法计数器。
（2）分析图13（b ）电路的逻辑功能，并画出完整的状态转移图。
1CP
1
（a ） （b ）
图13 表3
数字电路与数字逻辑试卷A 答案及评分参考
一、填空题（本大题共10小题，每空格1分，共10分） 1．（1000100）2 2．真值表 3．A
4． L =（A +B ）C 5．低电平。
6．增大 7．Moore 8．过渡 9．翻转
10．4
二、选择题（本大题共10小题，每小题2分，共20分）
11．C 12．B 13．C 14．C 15．B 16．C 17．D 18．A 19．A 20．B 三、分析题（本大题共6小题，每小题6分，共36分） 21． 解：（1）卡诺图（3分）
10110010××××1
1
×
×
0001111000011110
AB
CD
Z
简化结果：Z A CD BD =++（3分） 22．解：（1）分析过程（4分）
A =1，Z
B
C =⋅ A =0，01Z C =⋅=
（2）最简与或形式（2分）：=+=++Z A BC A A B C ⋅
23．（1）分析过程（4分）
10Z ABC ABC AB AB =++⋅+⋅
（2）最简与或形式（2分）：Z ABC ABC AB A C AB =++=+ 24．解：（6分）
CP
D Q
25．解：（6分）
Q 0Q 1Q 2Q 3
26．（1）单稳触发电路（2分） （2）波形（共4分，各2分）
+6V
+6V 000
t
t
t v I v C +4V v
27．解：（1）各触发器驱动方程（3分）
FF0：0210,1J Q Q K == FF1：10120,J Q K Q Q ==+ FF2：2102,1J Q Q K == （2）状态真值表（6分）
（3）状态转移图（1分）
（4）4位加法计数，能自启动（1分） （5）700Hz/4=175Hz （1分）
四、设计题（本大题共2小题，第28小题10分，第29小题12分，共22分） 28
（2）卡诺图化简（3分）
A
0BC
1
00011110
Y
010××
×
×
A
0BC
10001
11
10
G 0
01××
×
×
B
A B A G ==1
A
C B A C B Y ⋅=+=
A
0BC
1
00011110
R 100××
×0
×
G
C
R =Y
R
（3）逻辑图（3分）
29．解
（1）六进制加法计数器设计（6分）
（2）功能说明（3分）：九进制减法计数器 状态转移图（3分）。