3组合逻辑电路习题解答
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自我检测题
1.组合逻辑电路任何时刻的输出信号,与该时刻的输入信号 有关 ,与以前的输入信号 无关 。
2.在组合逻辑电路中,当输入信号改变状态时,输出端可能出现瞬间干扰窄脉冲的现象称为 竞争冒险 。
3.8线—3线优先编码器74LS148的优先编码顺序是7I 、6I 、5I 、…、0I ,输出为
2Y 1Y 0Y 。输入输出均为低电平有效。当输入7I 6I 5I …0I 为11010101时,输出2Y 1Y 0Y 为
010 。
4.3线—8线译码器74HC138处于译码状态时,当输入A 2A 1A 0=001时,输出07Y ~Y = 11111101 。
5.实现将公共数据上的数字信号按要求分配到不同电路中去的电路叫 数据分配器 。 6.根据需要选择一路信号送到公共数据线上的电路叫 数据选择器 。
7.一位数值比较器,输入信号为两个要比较的一位二进制数,用A 、B 表示,输出信号为比较结果:Y (A >B ) 、Y (A =B )和Y (A <B ),则Y (A >B )的逻辑表达式为B A 。
8.能完成两个一位二进制数相加,并考虑到低位进位的器件称为 全加器 。 9.多位加法器采用超前进位的目的是简化电路结构 × 。 (√,× ) 10.组合逻辑电路中的冒险是由于 引起的。 A .电路未达到最简 B .电路有多个输出
C .电路中的时延
D .逻辑门类型不同
11.用取样法消除两级与非门电路中可能出现的冒险,以下说法哪一种是正确并优先考虑的?
A .在输出级加正取样脉冲
B .在输入级加正取样脉冲
C .在输出级加负取样脉冲
D .在输入级加负取样脉冲
12.当二输入与非门输入为 变化时,输出可能有竞争冒险。
A .01→10
B .00→10
C .10→11
D .11→01
13.译码器74HC138的使能端321E E E 取值为 时,处于允许译码状态。 A .011 B .100 C .101 D .010
14.数据分配器和 有着相同的基本电路结构形式。
A .加法器
B .编码器
C .数据选择器
D .译码器 15.在二进制译码器中,若输入有4位代码,则输出有 个信号。 A .2 B .4 C .8 D .16
16.比较两位二进制数A=A 1A 0和B=B 1B 0,当A >B 时输出F =1,则F 表达式是 。
. .
A .
B A F = B .0101B B A A F ++=
.0011B A B A F ++=
17.集成4位数值比较器74LS85级联输入I A <B 、I A=B 、I A >B 分别接001,当输入二个相等的4位数据时,输出F A <B 、F A=B 、F A >B 分别为 。
A .010
B .001
C .100
D .011
18.实现两个四位二进制数相乘的组合电路,应有 个输出函数。 A . 8 B .9 C .10 D .11
19.设计一个四位二进制码的奇偶位发生器(假定采用偶检验码),需要 个异或门。
A .2
B .3
C .4
D .5
20.在图T3.20中,能实现函数C B B A F +=的电路为 。
A B F
C
B A
C F
(a ) (b ) (c )
图T3.20
A .电路 (a )
B .电路(b )
C .电路(c )
D .都不是
习 题
1.分析图P3.1所示组合逻辑电路的功能,要求写出与-或逻辑表达式,列出其真值表,并说明电路的逻辑功能。
A B C
S
图P3.1
. .
解: CO =AB +BC +AC
AC BC AB C B A ABC CO C B A ABC S +++++=+++=)()(
AC BC AB C B A ABC )(+++=
AC BC AB C AC BC AB B AC BC AB A ABC +++= A B AB C AC C A B C BC B A ABC +++= C B A C B A C B A ABC +++=
真值表
电路功能:一位全加器,A 、B 为两个加数,C 为来自低位的进位,S 是相加的和,CO 是进位。
2.已知逻辑电路如图P3.2所示,试分析其逻辑功能。
A
B C
图P3.2
解:(1)逻辑表达式
ABC P =1,ABC B BP P ==12,ABC A AP P ==13,ABC C CP P ==14 432P P P F =ABC C ABC A ABC B =ABC C ABC A ABC B ++=
)(C B A ABC ++= ))((C B A C B A ++++=
C AB C B A C B A BC A C B A C B A +++++=
. .
(2)真值表
(3)功能
从真值表看出,ABC =000或ABC =111时,F =0,而A 、B 、C 取值不完全相同时,F =1。故这种电路称为“不一致”电路。
3.试用与非门设计一组合逻辑电路,其输入为3位二进制数,当输入中有奇数个1时输出为1,否则输出为0。
解:(1
(2)ABC C B A C B A C B A ABC C B A C B A C B A F ⋅⋅⋅=+++=(无法用卡诺图化简) (3)逻辑图
F
4.4位无符号二进制数A ( A 3A 2A 1A 0),请设计一个组合逻辑电路实现:当0≤A <8或12≤A <15时,F 输出1,否则,F 输出0。 解:(1)真值表: