数字逻辑与系统设计
数字逻辑电路与系统设计课程设计
数字逻辑电路与系统设计课程设计课程设计目的通过本课程设计的学习，学生应能够掌握数字逻辑电路基本概念、设计方法以及应用技巧。
学生应该能够使用Verilog HDL或者其他硬件描述语言（HDL）设计数字逻辑电路和系统，并能够基于FPGA平台设计和实现数字电路系统。
课程设计内容本次课程设计主要包含以下内容：1.数字电路基础知识：数字逻辑基本理论、逻辑门的特点、数字电路的抽象层次。
2.Verilog HDL编程：Verilog HDL的基本语法、数据类型、运算符以及常用结构体。
3.组合逻辑电路设计：组合逻辑电路的设计方法、Karnaugh图、逻辑门级联、多路复用器/解复用器、译码器、比较器等。
4.时序逻辑电路设计：时序逻辑电路的设计方法、触发器、寄存器、计数器等。
5.FPGA系统设计：FPGA的基本原理和结构、FPGA开发板的使用、FPGA系统设计的流程以及示例项目。
课程设计要求1.课程设计可以采用Verilog HDL或者其他HDL编程语言。
2.参与者需要结成小组，每个小组3-5人。
3.每个小组需要完成一项数字电路设计项目，包括设计报告和实验验证。
4.每个小组需要在课程结束时提交一份完整的设计报告以及实验数据和项目代码。
5.设计项目可以是基于组合逻辑或时序逻辑的电路系统设计，包括但不限于多路选择器、加法器、比较器、寄存器、时钟控制器、计数器、显示控制器等。
6.设计报告应该包含问题描述，设计总体方案，设计分级具体实现以及实验结果和分析等。
7.实验验证应该使用FPGA开发板完成，需要进行基准测试，并按照设计要求逐步进行验证。
8.设计报告和实验验证需要进行小组汇报，并进行讨论。
课程设计参考资料1.Verilog HDL编程指南(第二版), 王自发, 清华大学出版社，20182.数字逻辑与计算机设计，M. Morris Mano, Pearson Education,20153.FPGA原理与设计, Jonathan W. Valvano, Morgan & Claypool,20114.FPGA开发实战, Evan A. Curtice, Packt Publishing, 2018结论通过本次课程设计，学生将能够熟练掌握数字逻辑电路设计的基础知识和关键技能。
数字逻辑与数字系统设计课程设计
数字逻辑与数字系统设计课程设计一、课程设计背景数字逻辑与数字系统设计课程介绍了数字电路的基本概念、设计和分析方法。
数字逻辑是电子技术中非常重要的一部分，广泛应用于计算机、通信、自动化控制、计算器、游戏机等电子产品。
通过本课程的学习，学生将掌握数字逻辑和数字系统设计的基本原理和方法。
二、课程设计内容本次数字逻辑与数字系统设计课程设计主要分为以下几个部分：1.实验一：Karnaugh图和逻辑多路选择器设计实验2.实验二：数字逻辑电路的组合设计实验3.实验三：数字电路的时序设计实验4.实验四：数字系统设计实验5.实验五：数字逻辑综合设计实验实验一：Karnaugh图和逻辑多路选择器设计实验通过本实验，学生将学会运用Karnaugh图方法设计简单的逻辑电路，掌握最小化布尔函数的方法。
同时，学生将学习多路选择器的设计方法，掌握多路选择器的应用技巧。
实验二：数字逻辑电路的组合设计实验通过本实验，学生将学习的是数字逻辑电路的组合设计方法，包括基本逻辑门和复杂逻辑电路的设计技术。
同时，学生还将掌握基本电路的仿真方法，通过仿真软件对电路进行验证。
实验三：数字电路的时序设计实验在本实验中，学生将掌握数字电路的时序设计方法，了解时序电路的作用、分类和基本原理。
同时，学生将学习数字电路时序仿真的方法，能够进行基本时序电路模拟。
实验四：数字系统设计实验在本实验中，学生将学习数字系统设计的基本方法和过程，包括总体结构设计、输入输出接口的设计、存储器的设计等；同时，学生还将了解数字系统的仿真和测试方法，对设计的数字系统进行仿真和测试。
实验五：数字逻辑综合设计实验在本实验中，学生将通过数字逻辑综合设计，掌握数字逻辑综合应用技巧，并能够在实践中学习根据需求进行电路综合的方法。
三、课程设计特点本次数字逻辑与数字系统设计课程设计不仅注重理论教学，更加强调实践教学，特点如下：1.注重实验教学，对学生的动手能力和实践能力进行提高。
2.充分利用仿真软件进行电路设计和验证，使学生在熟悉实际电路设计方法的同时，也能提高计算机仿真的技能和水平。
数字逻辑电路与系统设计课件
用于计数和控制时序，常用于实现定时器和分频器。
移位器
用于二进制数据的移位操作，常用于数据格式化和数据传输。
顺序脉冲发生器
用于产生一定规律的顺序脉冲信号，常用于控制电路的工作流程。
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数字系统设计
数字系统概述
数字系统的基本概念
数字系统是指使用离散的二进制数字信号进行信息处理的系统。它主要由逻辑 门电路、触发器、寄存器、加法器等基本元件组成，具有精度高、稳定性好、 易于大规模集成等优点。
实现逻辑功能
根据状态转换图，实现相应的 逻辑功能。
确定设计目标
明确设计时序逻辑电路的目的 和要求，如实现特定的功能、 达到一定的性能指标等。
设计状态转换图
根据设计要求，设计状态转换 图，确定状态和输出。
验证设计
通过仿真或实验验证设计的正 确性和可行性。
常用时序逻辑电路
寄存器
用于存储二进制数据，常用于数据传输和数据处理。
集成化和智能化技术的发展，为数字 系统的设计带来了新的机遇和挑战。
数字系统的智能化是当前的一个重要 趋势，它使得数字系统能够具有更强 的自适应性、智能性和灵活性。
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分析输入和输出信号的逻辑关系，确定电路的功 能。
真值表和逻辑表达式
通过列出所有输入组合和对应的输出值，得到真 值表，并根据真值表推导出逻辑表达式。
3
逻辑功能描述
根据逻辑表达式或真值表，描述组合逻辑电路的 逻辑功能。
组合逻辑电路的设计
明确设计要求：确定输入和 输出信号，以及电路要实现 的功能。
根据功能要求，逐一确定每 个输入组合对应的输出值。
自底向上的设计方法
逻辑与数字系统设计课后题答案(李晶皎)-清华大学出版社
逻辑与数字系统设计课后习题答案第一章数字逻辑基础1-1（1）（102）（2）219 （3）（10.25）（4）（31.857）（5）（0.453125）1-2（1）11111（2）10000003）11100114）100101.10115）0.1011-111）不正确2）不正确3) 不正确4) 正确1-211)F=M(0,1,7)2)F=M(1,3,5)3)F=M(0,2,4,7)5)F=m（0,3,5,6,）第二章逻辑门电路2-5（a）I LED=（5-2-0.5）/0.33=7.58 mA第五章触发器5-1Q端波形：5-3(a) RS触发器的输入S=AQ'，R=BQ，代入RS触发器的特性方程Q*=S+R'Q 中，得：Q*=S+R'Q=AQ'+(BQ) 'Q=AQ'+(B'+Q')Q=AQ'+B'Q(b) RS触发器的输入S=CQ'，R=DQ'，代入RS触发器的特性方程Q*=S+R'Q中，得：Q*=S+R'Q=CQ'+(DQ') 'Q=CQ'+(B'+Q)Q=CQ'+Q=C+Q5-7RS触发器的输入S=(AQ')'=A'+Q，R=(BQ)'，代入RS触发器的特性方程Q*=S+R'Q中，得：Q*=S+R'Q=(A'+Q)+((BQ) ')'Q=A'+Q+BQ=A'+Q 5-8由图中可知，当R D'=0时，Q1*=Q2*=0；当R D'=1时，在时钟脉冲的下降沿，Q1*=D，Q2*=JQ2'+K'Q2= Q1Q2'，画出波形图：5-16(1) 正边沿JK触发器，在CP的上升沿Q*= JQ'+K'Q，波形如下：(2) 负边沿JK触发器，在CP的下降沿Q*= JQ'+K'Q，波形如下：5-20CP的上升沿触发，Q1*=D1=Q2；Q2*=D2=Q1'，波形图：5-24(2) D触发器的输入D=Q'，代入D触发器的特性方程Q*=D中，得：Q*=D=Q'(3) RS触发器的输入S=Q'，R=Q，代入RS触发器的特性方程Q*=S+R'Q 中，得：Q*=S+R'Q=Q'+Q'Q=Q'(4) JK触发器的输入J=K=1，代入JK触发器的特性方程Q*=JQ'+K'Q中，得：Q*=JQ'+K'Q=Q'(7) JK触发器的输入J=Q'，K=Q，代入JK触发器的特性方程Q*=JQ'+K'Q 中，得：Q*=JQ'+K'Q=Q'Q'+Q'Q=Q'(9) T触发器的输入T=Q'，代入T触发器的特性方程Q*=TQ'+T'Q中，得：Q*=TQ'+T'Q=Q'Q'+QQ=Q'+Q=1。
数字逻辑与数字系统课程设计简单计算器
简单计算器一、设计分析1、功能描述设计一个简单0-9数之间的加、减、乘法运算的计算器，，输入和输出均可以显示在数码管上。
2、实现工具1、用VHDL 语言文本形式输入；2、maxplusII行语言编写时序仿真和综合。
二、设计思想采用自顶向下的设计方式，分层进行设计。
设计分为五个模块进行；计算器模块、八位二进制数转化成8421BCD码模块，四选一数据选择器模块，七段显示译码器模块、模4计数器模块、模8计数器块、3—8译码器块。
顶层设计可以完全独立于目标器件芯片物理结构的硬件描述语言。
使用VHDL模型在所综合级别上对硬件设计进行说明、建模和仿真。
1、顶层原原理框图2、具体实现1、计算器模块、2、八位二进制数转化成8421BCD码模块3、四选一数据选择器模块4、七段显示译码器模块5、模4计数器模块6、模8计数器块7、3—8译码器块三、设计过程1、建立工程建立一个Project，命名为jiandanjisuanqi。
将各个模块生成的文件放在同一个文件夹下。
2、文本输入将各个模块的VHDL代码输入，保存并综合。
3、仿真建立各个模块的gdf图，设置输入波形并仿真。
4、顶层原理图输入利用各个模块生成的sym文件建立顶层原理图，编译并仿真。
5、硬件实现实验室提供的器件为FLEX10K，型号为EPF10K10LC84-4，将文件下载到器件当中，在实验箱中进行模拟。
四、整体框图五、VHDL部分代码及说明1、计算器模块、library IEEE;use IEEE.STD_LOGIC_1164.ALL;use IEEE.STD_LOGIC_ARITH.ALL;use IEEE.STD_LOGIC_UNSIGNED.ALL;entity jisuanqi isPort (a,b: in STD_LOGIC_VECTOR (3 downto 0);sel:in STD_LOGIC_VECTOR (1 downto 0); -----加减乘控制端s: out STD_LOGIC_VECTOR (7 downto 0));end jisuanqi;architecture Behavioral of jisuanqi issignal q1 ,q2: STD_LOGIC_VECTOR (3 downto 0);signal q3: STD_LOGIC_VECTOR (7 downto 0);signal q4: STD_LOGIC_VECTOR (1 downto 0);beginq1<=a;q2<=b;q4<=sel;process(q4,q3)begincase q4 iswhen "00" => ----加减乘算法q3<=q1+q2;s<=q3;when "01" =>if(q1>q2)thenq3<= q1-q2;s<=q3;elseq3<=q2-q1;s<=q3;end if;when "10"=>q3<=q1*q2;s<=q3;when "11"=>q3<=q1*q2;s<=q3;when others=>q3<="00000000";s<=q3;end case;end process;end Behavioral;2、八位二进制数转化成8421BCD码模块library IEEE;use IEEE.STD_LOGIC_1164.ALL;use IEEE.STD_LOGIC_ARITH.ALL;use IEEE.STD_LOGIC_UNSIGNED.ALL;entity bcd isPort (s : in STD_LOGIC_VECTOR (7 downto 0);a : out STD_LOGIC_VECTOR (3 downto 0);b : out STD_LOGIC_VECTOR (3 downto 0));end bcd;architecture Behavioral of bcd issignal q0: STD_LOGIC_VECTOR (7 downto 0);signal q1: STD_LOGIC_VECTOR (3 downto 0);signal q2: STD_LOGIC_VECTOR (3 downto 0);beginprocess(s)beginq0<=s;case q0 is ----把八位二进制数转化为8421BCD码when"00000000"=>q1<="0000";q2<="0000";when"00000001"=>q1<="0000";q2<="0001";when"00000010"=>q1<="0000";q2<="0010";when"00000011"=>…………………………….3、四选一数据选择器模块library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_signed.all;entity mux4_1 isport(d0,d1,d2,d3 :in std_logic_vector(3 downto 0);q :out std_logic_vector(3 downto 0);sel :in std_logic_vector(1 downto 0) );end mux4_1;architecture rtl of mux4_1 isbeginprocess(sel)begin ------实现从四个数据中选择一个出来if(sel = "00") thenq<=d0;elsif(sel = "01")thenq<=d1;elsif(sel = "10")thenq<=d2;elsif(sel = "11")thenq<=d3;end if;end process;end rtl;4、七段显示译码器模块library ieee;use ieee.std_logic_1164.all;entity bcd_7dis isport (bcdm: in std_logic_vector(3 downto 0);a,b,c,d,e,f,g : out std_logic);end bcd_7dis;architecture art of bcd_7dis issignal w : std_logic_vector(6 downto 0);beginprocess(bcdm)begina<=w(6);b<=w(5);c<=w(4);d<=w(3);e<=w(2);f<=w(1);g<=w(0);case bcdm is -----实现8421码转化为2进制码的转换when "0000" =>w<="1111110";when "0001" =>w<="0110000";when "0010" =>w<="1101101";when "0011" =>w<="1111001";when "0100" =>w<="0110011";when "0101" =>w<="1011011";when "0110" =>w<="1011111";when "0111" =>w<="1110000";when "1000" =>w<="1111111";when "1001" =>w<="1111011";when "1100" =>w<="0000001";when others =>w<="0000000";end case;end process;end art;5、模4计数器模块library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_signed.all;entity mo4 isport(q :out std_logic_vector(1 downto 0);clk :in std_logic);end mo4;architecture rtl of mo4 issignal qcl : std_logic_vector(1 downto 0);beginprocess(clk)begin ----实现模为4的计数if(clk'event and clk = '1')thenif(qcl = "11")thenqcl <= "00";elseqcl <= qcl + '1';end if;end if;q <= qcl;end process;end rtl;6、模8计数器块library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_unsigned.all;entity count_8 isport( clk:in std_logic;ql :out std_logic_vector(2 downto 0));end count_8;architecture rt1 of count_8 issignal qcl:std_logic_vector(2 downto 0);beginprocess(clk)begin ---- 实现模8的计数if(clk'event and clk='1') thenif (qcl="111") thenqcl<="000";elseqcl<=qcl+'1';end if;end if;ql<=qcl;end process;end rt1;7、3—8译码器块library ieee;use ieee.std_logic_1164.all;entity decode3_8 isport(d :in std_logic_vector(2 downto 0);y :out std_logic_vector(7 downto 0));end decode3_8 ;architecture rt1 of decode3_8 isbeginprocess(d)begincase d is ------实现3对8的译码when "000"=>y<="10000000";when "001"=>y<="01000000";when "010"=>y<="00100000";when "011"=>y<="00010000";when others=>y<="00000000";end case;end process;end rt1;六、各模块仿真结果1、计算器模块2、八位二进制数转化成8421BCD码模块3.、四选一数据选择器模块4、七段显示译码器模块5、模4计数器模块6、模8计数器块7、3—8译码器块8、整体仿真七、管脚锁定及硬件实现1、管脚锁定2、文件下载将文件下载完后在硬件实验箱中进行仿真检查。
数字逻辑与设计
数字逻辑与设计数字逻辑与设计是计算机科学与工程领域的重要学科，涉及计算机硬件的设计和实现。
在数字逻辑与设计中，我们研究和应用离散逻辑和二进制数系统来开发和优化计算机电路和系统。
1. 引言数字逻辑与设计是计算机科学与工程中的核心学科。
在计算机系统中，数字逻辑和电路扮演着至关重要的角色。
本文将介绍数字逻辑与设计的基本概念和应用，包括数字逻辑的基本原理、逻辑门电路的设计和组合逻辑与时序逻辑的区别。
2. 数字逻辑的基本原理数字逻辑是建立在离散逻辑和二进制数系统的基础上的。
离散逻辑是一种处理离散输入和输出信号的数学方法，而二进制数系统是一种使用两个状态（通常表示为0和1）来表示信息的系统。
数字逻辑的基本原理包括布尔代数、逻辑运算和真值表等概念。
3. 逻辑门电路的设计逻辑门电路是数字逻辑的基本构建模块，用于实现各种逻辑功能。
常见的逻辑门包括与门、或门、非门、异或门等。
逻辑门的设计是通过选择适当的逻辑门类型和连接方式来实现特定的逻辑功能。
设计逻辑门电路时需要考虑门延迟、功耗和面积等因素。
4. 组合逻辑与时序逻辑的区别组合逻辑和时序逻辑是数字逻辑中两种基本的电路类型。
组合逻辑电路的输出仅由当前输入决定，不存储任何状态信息，例如加法器和编码器等。
而时序逻辑电路的输出不仅取决于当前输入，还取决于过去的输入和状态信息，例如触发器和计数器等。
区分组合逻辑和时序逻辑对于正确设计和实现数字电路至关重要。
5. 逻辑设计工具与技术随着计算机科学与工程的不断发展，逻辑设计工具和技术也在不断进步。
计算机辅助设计（CAD）工具如Verilog和VHDL等提供了方便高效的逻辑设计环境。
同时，抽象级别的提升和硬件描述语言的应用使得逻辑设计更加灵活和可靠。
6. 应用案例数字逻辑与设计在计算机科学与工程中的应用领域广泛。
从单个逻辑门到复杂的处理器和芯片设计，数字逻辑为计算机硬件的实现提供了基础。
数字电路和系统在计算机、通信、嵌入式系统等领域都扮演着重要的角色。
数字逻辑与数字系统设计_中国矿业大学3中国大学mooc课后章节答案期末考试题库2023年
数字逻辑与数字系统设计_中国矿业大学3中国大学mooc课后章节答案期末考试题库2023年1.VHDL语言是一种结构化设计语言；一个设计实体（电路模块）包括实体与结构体两部分，实体体描述的是( )答案:器件外部特性2.请指出AlteraCyclone系列中的EP1C6Q240C8这个器件是属于( )答案:FPGA3.AHDL中，下列哪一个符号不是关系运算符答案:=>4.AHDL运算符优先级的说法正确的是( )答案:括号可以改变优先级5.AHDL中，正确给变量X赋值的语句是( )答案:x =a # b;6.在EDA中，ISP的中文含义是( )答案:在系统编程7.在EDA中，IP的中文含义是( )答案:知识产权核8.在AHDL的table语句中，条件句中的"=>"不是操作符号，它只相当与( )作用。
答案:then9.下面哪一个可以用作AHDL中的合法的子程序名( )答案:out10.下列那个流程是正确的基于EDA软件的FPGA/CPLD设计流程：答案:原理图/HDL文本输入→功能仿真→综合→适配→编程下载→硬件测试；11.AHDL语言中的if语句，下列代码哪一行有错误其中low, high为输入变量，Highest[1..0]为输出变量1 | IF high THEN --如果输入信号high为高电平则2 | Highest [] = 3; --highest []输出为3；3 | ELSEIF low THEN --若high和middle都为低电平则判断4 | Highest [] = 1; --low如果为高电平则highest []输出为15 | ELSE --若high,middle,low都为低电平则6 | Highest [] = 0; --highest_level[]输出为07 | END IF;答案:312.AHDL语言中触发器实体的定义与设置中，下列代码哪一行有错误1| SUBDESIGN bur_reg1 用SUBDESIGN标识程序名2| (3| clk, load, in[7..0] : INPUT; 在（）中定义输入输出管脚4| out[7..0] : OUTPUT;5| )6| VARIABLE 定义变量7| ff[8..1] : DFFE; 定义ff[]为八位数组DFFE触发器8| BEGIN9| ff[].clk = clk; 触发器的时钟输入端为clk10| ff[].ena = load; 触发器的使能端为load11| ff[].d = in[]; 输入信号in[]接到触发器的D输入端12| out[] = ff[]; 触发器的Q端接到输出端out13| END;答案:713.以下那个单词不是AHDL语言中的保留字答案:OUT14.FPGA 可编程逻辑基于的可编程结构基于（）。
数字逻辑与数字系统设计考研专业课资料
数字逻辑与数字系统设计考研专业课资料数字逻辑与数字系统设计是计算机科学与技术、电子信息工程等专业中的一门重要的基础课程。
它主要涉及数字电路、逻辑门、组合逻辑与时序逻辑等内容。
在考研中，该课程的内容通常需要通过理论学习与实践操作相结合的方式进行掌握。
本文将介绍一些数字逻辑与数字系统设计考研专业课的学习资料，并分享一些学习方法和技巧。
一、教材推荐在数字逻辑与数字系统设计考研专业课的学习过程中，选择适合自己的教材非常重要。
这里给大家推荐几本经典的教材：《数字逻辑与计算机设计》（M. Morris Mano）和《计算机体系结构与设计（原书第5版）》（David A. Patterson, John L. Hennessy）。
这两本教材都是权威、经典而且内容丰富，在考研复习中起到很好的参考作用。
二、学习方法与技巧1. 制定学习计划：在学习数字逻辑与数字系统设计时，制定一个详细的学习计划非常重要。
合理地安排每天的学习时间和任务，将课程内容分模块进行学习，有针对性地进行复习与巩固。
2. 多做习题：数字逻辑与数字系统设计是一门注重实践操作的课程，因此多做习题是非常必要的。
通过做习题，可以提高对知识点的理解和记忆，并加深对实际应用的认识。
3. 注重实践操作：数字逻辑与数字系统设计的主要内容是数字电路的设计与实现，因此注重实践操作是非常重要的。
通过使用实验箱、逻辑分析仪等工具，进行实际的数字电路搭建和测试，能够更好地掌握相关知识。
4. 制作笔记与总结：在学习的过程中，适当制作笔记和总结非常有益。
通过整理和梳理知识点，可以加深对知识的理解和记忆，并方便日后的复习与回顾。
5. 寻求帮助：如果在学习过程中遇到困难或疑惑，不要犹豫，应该及时向老师或同学请教。
寻求帮助可以更快地解决问题，提高学习效果。
三、学习资源推荐除了教材外，还有一些其他的学习资源能够帮助我们更好地学习数字逻辑与数字系统设计。
这里推荐几个值得关注的资源：1. Mooc课程：很多在线教育平台都提供了数字逻辑与数字系统设计的相关课程，比如Coursera、edX等。
数字逻辑与数字系统课程设计报告
课程设计报告课程：数字逻辑与数字系统课题：多功能数字电子钟姓名：学号：学院：班级：指导老师：设计日期：一、设计要求1.具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。
2.精度要求为1s。
二、系统功能简介1.计时：正常工作状态下每天按24小时制计时并显示，蜂鸣器无声，逢整点报时。
2.整点报时：蜂鸣器在59分钟的51、53、55、57秒时发出频率为512hz的低音，在59秒时发出1024hz的高音，结束时为整点。
3.显示：要求采用扫描显示方式驱动8个LED数码管显示小时、分、秒、横线。
4.闹钟：闹钟定时时间到，蜂鸣器发出周期1秒的“滴、滴”声，持续时间30秒钟。
5.调时和校时：按动开关mode使计时与闹钟时间显示切换。
按下按动set键进入“小时”定时状态，同时显示小时的两位闪烁，此时如果按下k键，小时进位；然后继续按set键“分钟”的两位闪烁，按下k键，分进位；再按下set键“秒“的两位闪烁，按下k键，秒清零。
闹钟调时方法类似。
三、系统简介1.开发系统：windows xp/982.开发软件：MAX+PIUS II3.开发芯片：EP1K10TC100—3四、主要模块简介此系统由控制器(crt)、计时调时模块(time)、闹钟模块(baoshi)、定时模块(dingshi)、动显模块(dongxian1)和分频模块(fenpin)组成。
数字钟系统总体结构框图：1.控制模块：此模块主要为控制系统整体变换的模块，有f4hz,k,set,reset,mode五个控制时钟输入，f4hz驱动控制模块，mode键是让闹钟显示和计时显示两种状态互相切换的。
当set有效时，小时闪烁，当按下k键时，小时进行校时加1；当继续按下set键时，分闪烁，当按下k键时，分进行校时加1；当继续按下set键时，秒闪烁，当按下k键时，秒清零，继续按下set键，回复正常计时状态。
当按下mode键时，进行计时和闹钟时间切换。
数字逻辑与数字系统设计-基于VHDL语言描述课程设计
数字逻辑与数字系统设计-基于VHDL语言描述课程设计简介数字逻辑与数字系统设计是计算机科学和工程中的一门重要课程，它涉及到硬件电路的设计和实现。
本文将介绍数字逻辑与数字系统设计中的VHDL语言描述，以及如何基于VHDL语言描述来进行数字系统的设计。
VHDL语言描述VHDL是一种硬件描述语言，它是IEEE标准1076的一部分，是一种文本描述数字电路、系统和信号的详细语言。
VHDL还可以描述模拟电路和数字信号处理系统。
VHDL的设计流程包括建立系统规范、编写代码、生成模拟和仿真。
编写代码可以通过三种不同的方法进行：•行为级描述：描述系统的功能，以及模块之间的交互；•数据流描述：根据输入变量的状态计算输出变量的状态；•结构描述：定义模块和信号的结构、层次结构和网表。
在VHDL中，模块和信号需要有一个基本的结构。
模块可以细分为实体(entity)和体枚(architecture)，以及连接点(port)。
在体枚中，设计者可以通过描述行为来定义模块的内部结构，例如使用过程(process)、函数(function)、计数器(counter)等，从而描述模块的行为。
连接点则是模块的输入、输出接口，用于与其它模块连接，并且必须在实体中定义。
信号则是用于电路中传输数据、状态、时序等信息的实体。
它可以被定义为标量或向量，可以是定长或不定长。
在VHDL语言中使用变量(var)、常量(constant)和信号(signal)的方法可以对数字电路进行建模和仿真，并基于VHDL语言描述来进行数字系统的设计。
VHDL语言描述的应用——课程设计利用VHDL语言描述实现的数字电路在实际应用中非常广泛，可以用于网络交换芯片、信号处理器和数字嵌入式系统等领域。
在数字逻辑与数字系统设计中，也具有很高的实用性。
以一个简单的数字系统设计为例，该设计实现了数字加法器的功能，在VHDL 语言表述下的代码如下：-- 定义模块entity adder isport(A_i,B_i:in std_logic_vector(3downto0);S_o :out std_logic_vecotr(3downto0));end adder;-- 定义体枚architecture rtl of adder isbeginS_o <= A_i + B_i; -- 行为描述end rtl;在这个例子中，我们定义了一个模块adder，该模块由A_i和B_i两个输入端口、S_o一个输出端口组成。
数字逻辑与数字系统设计课程大纲
数字逻辑与数字系统设计课程大纲“数字逻辑与数字系统设计”教学大纲课程编号：OE2121017课程名称：数字逻辑与数字系统设计英文名称：Digital Logic and DigitalSystem Design学时：60 学分：4课程类型：必修课程性质：专业基础课适用专业：电子信息与通信工程（大类）开课学期：4先修课程：高等数学、大学物理、电路分析与模拟电子线路开课院系：电工电子教学基地及相关学院一、课程的教学任务与目标数字逻辑与数字系统设计是重要的学科基础课。
该课程与配套的“数字逻辑与数字系统设计实验”课程紧密结合，以问题驱动、案例教学、强化实践和能力培养为导向，通过课程讲授、单元实验、综合设计项目大作业、设计报告撰写、研讨讲评等环节，实现知识能力矩阵中1.1.2.2、1.2.1.2以及2.5、2.6、3.6、4.1、4.2的能力要求。
要求学生掌握数字电路的基本概念、基本原理和基本方法，了解电子设计自动化（EDA：Electronic Design Automation）技术和工具。
数字电路部分要求学生掌握数制及编码、逻辑代数及逻辑函数的知识；掌握组合逻辑电路的分析与设计方法，熟悉常用的中规模组合逻辑部件的功能及其应用；掌握同步时序逻辑电路的分析和设计方法，典型的中大规模时序逻辑部件。
EDA设计技术部分，需要了解现代数字系统设计的方法与过程，学习硬件描述语言，了解高密度可编程逻辑器件的基本原理及开发过程，掌握EDA 设计工具，培养学生设计较大规模的数字电路系统的能力。
本课程教学特点和主要目的：（1）本课程概念性、实践性、工程性都很强，教学中应特别注重理论联系实际和工程应用背景。
（2）使学生掌握经典的数字逻辑电路的基本概念和设计方法；（3）掌握当今EDA工具设计数字电路的方法。
（4）本课将硬件描述语言(HDL)融合到各章中，并在软件平台上进行随堂仿真, 通过本课和实验教学, 使学生掌握新的数字系统设计技术.虽然现代设计人员已经很少使用传统的设计技术，但传统的设计可以让学生直观地了解数字电路是如何工作的，并可以为EDA设计工具所进行的操作提供说明，让学生进一步了解自动化设计技术的优点。
数字逻辑与系统课程设计
《数字电子技术》课程设计总结报告题目：多功能数字种（设计一）指导教师：设计人员：组号：班级：目录一．课程设计题目和目的 (2)1.1 课程设计题目 (2)1.2课程设计目的 (2)二．课程设计要求 (2)三．设计原理及框图 (3)3.1 设计原理 (3)3.2 框图设计 (6)四．各功能模块电路图 (7)4.1 晶体振荡电路 (7)4.2 时、分、秒整体模块 (8)4.2.1 分、秒计数器设计模块 (9)4.2.2 时计数器模块 (9)4.3 整点报时（蜂鸣器）电路 (10)4.4 校正电路 (11)4.5 译码器 (12)五．元器件 (13)5.1 元器件清单 (13)5.2 元器件内部结构及引脚图 (13)六．课程设计总结 (17)……课程设计题目和目的……1.1课程设计题目《设计多功能数字钟》1.2．本次课程设计设计目的：1.熟悉集成电路的引脚安排。
2.掌握各芯片的逻辑功能及使用方法。
3.了解面包板结构及其接线方法。
4.了解数字钟的组成及工作原理。
5.熟悉数字钟的设计与制作。
…………课程设计要求……………设计要求：(1)．设计指标时间以24小时为一个周期；显示时、分、秒；有校时功能，可以分别对时及分进行单独校时，使其校正到标准时间；计时过程具有报时功能，当时间到达整点前10秒进行蜂鸣报时；为了保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号。
(2)．设计要求画出电路原理图（或仿真电路图）；元器件及参数选择；(3)．制作要求自行装配和调试，并能发现问题和解决问题。
(4)．编写设计报告写出设计与制作的全过程，附上有关资料和图纸，有心得体会。
…………设计原理及框图…………3.1 数字钟的工作原理（1）晶体振荡器电路晶体振荡器是构成数字式时钟的核心，它保证了时钟的走时准确及稳定。
图3-1所示电路通过CMOS非门构成的输出为方波的数字式晶体振荡电路，这个电路中，CMOS非门U1与晶体、电容和电阻构成晶体振荡器电路，U2实现整形功能，将振荡器输出的近似于正弦波的波形转换为较理想的方波。
数字逻辑与数字系统课程设计
数字逻辑与数字系统课程设计1、名目第一章第一章概述概述第二章第二章方案论证方案论证2.12.1信号灯转换器信号灯转换器……………………………………………………222.22.2倒计时计数器倒计时计数器……………………………………………………3……………………………………………………32.32.3倒计时计数器与信号灯转换连接倒计时计数器与信号灯转换连接………………………………3………………………………32.42.4秒脉冲产生电路秒脉冲产生电路…………………………………………………4…………………………………………………42.52.5电路测试与仿真电路测试与仿真…………………………………………………7…………………………………………………7心得与体会心得与体会……………2、………………………………………………8……………………………………………………………81第一章第一章概述城市十字交叉路口为确保车辆、行人安全有序地通过，都设有指挥信号灯。
交通信号灯的出现，使交通得以有效管制，对于疏导交通、提高道路事故有明显效果。
因此，如何采纳合适的方法，使交通信号的掌握与交通疏导有机结合，最大限度缓解主干道与匝道、城区同周边地区的交通拥堵状况。
以下就是一个交通灯掌握系统的电路原理、设计和仿真测试等问题。
要求如下：〔1〕在十字路口两个方向上个设置一组红、黄、绿信号灯，其中，绿灯亮的时间为8s，黄灯亮的时间为2s；〔2〕在绿灯转向红灯的过程中，先由绿灯转成黄灯，黄灯亮完2秒后，快速换回红灯亮，同时也让对方由红灯转为绿灯。
3、〔3〕假如发生特别事情，可以手动按下开关，其中一个方向常亮绿灯，倒计时停止。
特别事情结束后，可手动按下开关，恢复正常状态。
2第二章第二章总体方案设计总体方案设计依据试验要求，智能交通灯系统应由信号灯转移、倒数计时器、秒脉冲信号三部分组成，其原理如下：单元电路设计单元电路设计2.12.1信号灯转换器信号灯转换器用以下六个符号分别代表东西〔A〕和南北〔B〕方向上信号灯的状态：GA：东西方向上绿灯亮；GB：南北方向上绿灯亮；YA：东西方向上黄灯亮；YB：南北方向上黄灯亮；RA：东西方向上红灯亮；RB：南北方向上红灯亮。
数字逻辑与数字系统设计教案
数字逻辑与数字系统设计教案教案：数字逻辑与数字系统设计教学目标1.学生能够理解数字逻辑的基本概念和原理。
2.学生能够掌握数字系统的基本组成和设计方法。
3.学生能够运用数字逻辑和数字系统的知识进行简单的设计。
4.培养学生对数字逻辑和数字系统的兴趣和热情。
5.提高学生分析和解决问题的能力。
教学内容1.数字逻辑的基本概念：二进制数、逻辑门、布尔代数等。
2.数字系统的组成：中央处理器、存储器、输入输出设备等。
3.数字系统的设计方法：系统架构设计、硬件描述语言、电路设计等。
4.数字逻辑的应用：计算机、通信、自动化等。
教学难点与重点难点：数字系统的设计方法，特别是硬件描述语言和电路设计。
重点：数字逻辑的基本概念和原理，数字系统的组成和设计方法。
教具和多媒体资源1.黑板：用于讲解基本概念和公式。
2.投影仪：展示数字系统的架构和电路设计。
3.教学软件：用于模拟数字系统的运行和测试。
4.实验设备：用于学生实践数字系统的设计和搭建。
教学方法1.激活学生的前知：回顾二进制数的概念，为理解数字逻辑打下基础。
2.教学策略：讲解、示范、小组讨论、实验。
3.学生活动：小组讨论、实践操作、案例分析。
教学过程1.导入：通过展示一些基于数字逻辑的现代科技产品，如智能手机和计算机，来激发学生的兴趣。
2.讲授新课：首先介绍数字逻辑的基本概念，然后讲解逻辑门和布尔代数的原理，接着介绍数字系统的组成，最后讲解数字系统的设计方法。
3.巩固练习：给出一些实例，让学生运用所学知识进行简单的数字系统设计。
4.归纳小结：回顾本节课所学的知识点，总结重点和难点内容。
评价与反馈1.设计评价策略：测试、小组报告、观察、口头反馈。
2.为学生提供反馈，帮助他们了解自己的学习状况，并指导他们如何改进。
作业布置1.阅读相关课文和资料，整理笔记。
2.完成教师布置的习题和练习题。
3.尝试设计一个简单的数字系统，并对其进行测试和调试。
数字逻辑与数字系统课程设计
汽车尾灯控制器设计实验报告实验地点硬件实验室(1—21)专业计算机软件工程年级 04级姓名林圣春指导教师连晋平实验时间 2006-6-10数字逻辑与数字系统课程设计课程设计作为实践教学的一个重要环节，对提高创新精神和实践能力、发展个性具在重要作用。
除了必要的验证性实践以训练实验能力和实验结果整理的能力外，安排综合性课程设计对于提高学生全面应用本课程知识进行分析问题和解决问题的能力具有重要意义。
本章给出了一些经典的数字逻辑与数字系统课程设计题目，部分题目给出了功能框图及简要分析。
3.1课程设计教学大纲课程设计作为数字逻辑与数字系统课程的重要组成部分，目的是使学生进一步理解课程内容，基本掌握数字系统设计和调试的方法，增加集成电路应用知识，培养学生实际动手能力以分析、解决问题的能力。
3.1.1课程设计目的和意义按照本学科教学培养计划要求，在学完专业基础课数字逻辑与数字系统课程后，应进行课程设计，其目的是使学生更好地巩固和加深对基础知识的理解，学会设计中小型数字系统的方法，独立完成调试过程，增强学生理论联系实际的能力，提高学生电路分析和设计能力。
通过实践教学引导学生在指导下有所创新，为专业课的学习和日后工程实践奠定基础。
3.1.2课程设计基本要求1.教学基本要求要求学生独立完成选题设计，掌握数字系统设计方法；完成系统的仿真、装配及调试，掌握数字系统的仿真与调试技术；在课程设计中要注重培养工程质量意识，并写出课程设计报告。
教师应事先准备好课程任务书、指导学生查阅有关资料，安排适当的时间进行答疑，帮助学生解决课程设计过程中的问题。
2.能力培养要求1）通过查阅手册和有关文献资料，培养学生独立分析和解决实际问题的能力。
2）通过实际电路方案的分析比较、设计计算、元件选取、仿真、安装调试等环节，掌握简单实用电路的分析方法和工程设计方法。
3）掌握常用仪器设备的使用方法，学会简单的实验调试，提高动手能力。
4）综合应用课程中学到的理论知识去独立完成一个设计任务。
数字逻辑与数字系统设计
数字逻辑与数字系统设计数字逻辑与数字系统设计是计算机科学领域的重要基础知识，涉及到计算机硬件的运作原理和数字电路的设计。
本文将从数字逻辑的基本概念入手，逐步介绍数字系统设计的过程，并探讨常见的数字逻辑电路及其应用。
一、数字逻辑基础数字逻辑是研究数字信号的逻辑关系与运算的学科。
在计算机系统中，二进制的0和1被用于表示逻辑值，0代表假，1代表真。
数字逻辑中的基本逻辑运算有与、或、非、异或等。
通过这些运算，可以实现数字信号的处理和控制。
1. 与门与门是最基本的逻辑门之一，其输出只有在所有输入都为1时才为1，否则为0。
与门常用记号为“&”或“∧”。
2. 或门或门是另一种基本的逻辑门，其输出只有在至少一个输入为1时才为1，否则为0。
或门常用记号为“|”或“∨”。
3. 非门非门是最简单的逻辑门之一，其输出与输入相反。
非门常用记号为“¬”或“~”。
4. 异或门异或门是常用的逻辑门，其输出只有在输入不相同时才为1，否则为0。
异或门常用记号为“⊕”。
以上是数字逻辑中最基本的逻辑门，不同的逻辑门可以组合成更复杂的数字逻辑电路。
二、数字系统设计数字系统设计是将数字逻辑门和其他电子元件组合在一起，实现特定功能的过程。
在数字系统设计中，常用的设计方法是组合逻辑设计和时序逻辑设计。
1. 组合逻辑设计组合逻辑设计是指通过组合不同的逻辑门，根据输入产生特定的输出。
组合逻辑电路没有存储元件，只有输入和输出，输出仅取决于当前的输入。
2. 时序逻辑设计时序逻辑设计是指通过组合逻辑电路和存储元件，实现带有状态的数字系统。
时序逻辑电路的输出不仅与当前输入有关，还与之前的输入和存储元件的状态有关。
三、常见的数字逻辑电路及应用1. 加法器加法器是一种常见的数字逻辑电路，用于将两个二进制数相加。
全加器是一种常见的加法器，通过多个全加器的串联可以实现任意位数的加法运算。
2. 计数器计数器是一种递增或递减的数字逻辑电路，常用于计数和时序控制。
数字逻辑与数字系统第四版课程设计
数字逻辑与数字系统第四版课程设计设计背景随着科技的快速发展，数字系统的应用范围越来越广泛，这也使得数字逻辑与数字系统的研究变得日益重要。
数字逻辑指的是一种基于逻辑组合的方法，用于执行数字计算和处理，数字系统则是利用数字逻辑实现的具有特定功能的系统。
本次数字逻辑与数字系统的课程设计旨在帮助学生更好地掌握数字逻辑与数字系统的基础理论及应用方法，提高学生的实际能力与创新能力。
设计内容任务一：设计数字电路本任务主要是让学生在课程学习的基础上，掌握数字电路的基本设计方法及流程。
首先，学生需要根据所学知识和设计要求，确定数字电路的输入输出端口和功能，并设计电路的逻辑门电路图。
然后，学生需要使用仿真软件验证电路设计的正确性，并进行电路布线和调试，最终得到功能正常、运行稳定的数字电路。
任务二：实现数字系统本任务主要是让学生根据所学知识和实际需求，设计一个完整的数字系统。
通过任务一的电路设计，学生可以将其作为基础模块进行扩展和组合，实现完整的数字系统。
此外，学生还需考虑数字系统的并行性控制、数据传输等问题，并进行仿真和测试，保证数字系统达到预期的效果和稳定性。
任务三：论文撰写与答辩本任务主要是让学生将数字逻辑与数字系统的课程设计结果撰写成论文，并在答辩中对设计方案进行展示和演示。
学生需要在论文中详细介绍数字电路和数字系统的设计方法、硬件实现方案、软件实现方案和测试结果，并提出自己的思考和建议。
在答辩环节中，学生需根据论文内容进行展示和演示，并回答委员会的问题和疑惑。
设计目标目标一：掌握数字逻辑的基本理论本课程设计旨在让学生掌握数字逻辑的基本理论，包括数字电路的分类、逻辑门电路的设计和实现、Karnaugh图化简等知识点。
通过理论学习，学生能够深入了解数字逻辑的基本工作原理，为后续的数字系统设计打下良好的基础。
目标二：熟练掌握数字电路的设计方法在任务一中，学生需要熟练掌握数字电路的设计方法，包括逻辑门的选择和组合、真值表和卡诺图的化简、布线和调试等环节。
数字逻辑与数字系统设计习题参考答案
2.3解：根据逻辑图可直接写出逻辑表达式：(a) F= ；(b) F=
解：设3个输入变量分别为A、B、C，输出为F，按题意，其中有奇数个为1，则输出F＝1，因此可写出其逻辑表达式为F= 。根据逻辑表达式可绘制逻辑习题2.3图如下：
习题2.3图
2.4解：根据逻辑图可直接写出逻辑表达式：(a) F= ；(b) F=
2.5解：
(1)若A+B=A+C,则B=C
不正确。若A=1，B和C为不同值（如B＝0，C＝1或B＝1，C＝0），A+B=A+C仍然成立。
(2)若AB=BC,则A=C
不正确。若B=0，A和C为不同值，等式仍然成立。
(3)若1+A=B,则A+AB=B
1.6(1)(117)8=(1001111)2=(79)10
(2)(7456)8=(111100101110)2=(3886)10
(3)(23765.64)8=(10 0111 1111 0101.1101)2=(10229.8125)10
(4)(0.746)8=(0.11111)2=(0.96875)10
W=A+BD+BCX= Y= Z=
= = = =
根据化简并变换后的逻辑表达式可绘制逻辑习题4-12图所示下：
4.13解：
//4.6的VerilogHDL描述
module ex6(a,b,s,f);//
input a,b,s;
output f;
assign f=(s?b:a);
endmodule
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《数字电子技术基础》第五版
1.3 不同数制间的转换
一、二－十转换
D K i 2i K ( 0,1 )
例：
1 (1011.01)2 1 23＋ 0 22＋ 1 21＋ 1 20＋ 0 2－ ＋ 1 2－2
＝（ 11.25 )10
《数字电子技术基础》第五版
(1000 1111 1010 1100 0110 )2
《数字电子技术基础》第五版
五、八进制数与二进制数的转换
例：将(011110.010111)2化为八进制
(011 110. 010 111)2
(3
6 . 2
7)8
例：将(52.43)8化为二进制
(5
2 . 4
3)8
(101 010 . 100 011 )2
1
1
0
1
0
1
《数字电子技术基础》第五版
或
• 条件之一具备，结果发生 • Y= A OR B = A+B A 0 0 B 0 1 Y 0 1
1
1
0
1
1
1
《数字电子技术基础》第五版
非
• 条件不具备，结果发生 • Y A NOT A A 0 1 Y 1 0
《数字电子技术基础》第五版
•几种常用的复合逻辑运算
《数字电子技术基础》第五版
《数字逻辑与系统设计》
《数字电子技术基础》第五版
第一章
数制和码制
1.2 几种不同的数制 1.3 不同数制间的转换 1.5 几种常用的编码
《数字电子技术基础》第五版
1. 2 几种常用的数制
• 数制： ①每一位的构成 ②从低位向高位的进位规则
常用到的： 十进制，二进制，八进制，十六进制
几种常用的十进制代码
十进制数 0 1 2 余3码 0011 0100 0101 2421码 0000 0001 0010 5211码 0000 0001 0100 余3循环码 0010 0110 0111
3
4
0011
0100
0110
0111
0011
0100
0101
0111
0101
0100
5 6
7 8 9
故 ( 0.8125 )10 ( 0.1101 )2
《数字电子技术基础》第五版
三、二－十六转换
例：将(01011110.10110010)2化为十六进制
(0101 ,1110 .1011 ,0010 )2
(5 E B 2)16
四、十六－二转换
例：将(8FAC6)16化为二进制
(8 F A C 6)16
《数字电子技术基础》第五版
六、十六进制数与十进制数的转换
十六进制转换为十进制
D K i 16
i
K ( 0,115 )
十进制转换为十六进制：通过二进制转化
《数字电子技术基础》第五版
练习：
1.将下列数转换成等值的十进制数。
(1101.011)2 (13.375)10
(36.2)8 (30.25)10
2.编码顺序依次变化，按表中顺序变化时，相邻代码 只有一位改变状态。
编码顺序 0 1 2 3 4 5 6 7 二进制码 0000 0001 0010 0011 0100 0101 0110 0111 格雷码 0000 0001 0011 0010 0110 0111 0101 0100 编码顺序 8 9 10 11 12 13 14 15 二进制码 1000 1001 1010 1011 1100 1101 1110 1111 格雷码 1100 1101 1111 1110 1010 1011 1001 1000
1 2 3 4 7 0
故 (173)10 (10101101 )2
5 6
《数字电子技术基础》第五版
小数部分: 十进制小数转换成二进制数可采用“乘2取整 法”，直至求出要求的位数。
0.8125 2 整数部分＝ 1 ＝k 1 1.6250 0.6250 2 整数部分＝ 1 ＝k 2 1.2500 0.2500 2 整数部分＝ 0 ＝k 3 0.5000 0.5000 2 整数部分＝ 1 ＝k 4 1.000
0101 0110
0111 1000 1001
1000 1001
1010 1011 1100
1011 1100
1101 1110 1111
1000 1001
1100 1101 1111
1100 1101
1111 1110 1010
《数字电子技术基础》第五版
二、格雷码
特点：1.每一位的状态变化都按一定的顺序循环。
• 与非 或非
与或非
Y A B
Y A B
(4A.B)16 (74.69)10
2.将下列十进制数转换成二进制数和十六进制数。 (188.875)10 (1011 1100.1110)2 (BC.E)16 (25.7)10 (1 1001.1011)2 (19.B)16
《数字电子技术基础》第五版
1.5 几种常用的编码
一、十进制代码
8421码 （BCD码） 0000 0001 0010
二、十－二转换
整数部分:
十进制整数转换成二进制数可采用“除2取余
法”，直至商为0。
173余 数 ＝ 1＝k ∟ 2 ∟ 86余 数 ＝0 ＝k 2 ∟ 43余 数 ＝ 1＝k 2 ∟ 21余 数 ＝ 1＝k 2 ∟ 10余 数 ＝0 ＝k 2 ∟ 5余 数 ＝ 1＝k 2 ∟ 2余 数 ＝0 ＝k 2 1余 数 ＝ 1＝k ∟ 0 2
《数字电子技术基础》第五版
2.2 逻辑代数中的三种基本运算
与（AND） 或（OR） 非（NOT）
以A=1表示开关A合上，A=0表示开关A断开； 以Y=1表示灯亮，Y=0表示灯不亮； 三种电路的因果关系不同：
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与
• 条件同时具备，结果发生 • Y=A AND B = A&B=A· B=AB A 0 0 B 0 1 Y 0 0
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练习：
(01100110.0110)BCD=( 66.6 )10 (10110.1)2=( 16.8 )16=(26.4)8=( 22.5 )10
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第二章
2.2 2.3数基础
逻辑代数中的三种基本运算 逻辑代数的基本公式和常用公式 逻辑代数的基本定理 逻辑函数及其表示方法 逻辑函数的化简方法 具有无关项的逻辑函数及其化简