ORCAD使用中常见问题汇集及答案

ORCAD使用中常见问题汇集及答案
1、什么时FANOUT布线？ FANOUT布线：延伸焊盘式布线。

为了保证SMD器件的贴装质量，一般遵循在SMD 焊盘上不打孔的原则，因此用fanout布线，从SMD器件的焊盘向外延伸一小段布线，再放置VIA，起到在焊盘上打孔的作用。

在LAYOUT PLUS 中，用AUTO/Fanout/Board，实现fanout
1、什么时FANOUT布线？
FANOUT布线：延伸焊盘式布线。

为了保证SMD器件的贴装质量，一般遵循在SMD焊盘上不打孔的原则，因此用fanout布线，从SMD器件的焊盘向外延伸一小段布线，再放置VIA，起到在焊盘上打孔的作用。

在LAYOUT PLUS 中，用AUTO/Fanout/Board，实现fanout布线。

先要设置好FANOUT的参数。

在自动布线前要对PCB上各SMD器件先FANOUT布线。

2、现在顶层图上有四个模块，选中任一模块后，按右键选Descend Hierarchy后可进入子图，现在子图已画好，如何在顶层中自动生成PORT？而不用自己一个一个往上加PORT？（子图中已给一些管脚放置了PORT）
阶层式电路图的模块PIN脚要自己放置。

选中模块后用place pin快捷菜单。

自动应该不可能。

3、只是想把板框不带任何一层,单独输出gerber文件.该咋整?
发现在layout 自带的模板中，有一些关于板框和尺寸的定义，都是在notes层。

所以你也可以在设定板框时，尝试单独将obstacle type 设定为board outline,将obstacle layer 设定为 notes，当然要在layers对话框里添加上notes层，再单独输出notes层gerber
文件
4、层次原理图，选中，右键，Descend Hierarchy，出现错误：Unable to descend part.？建议重新设置层级、重新设置属性后就可以了
5、层次原理图是什么概念呢？
阶层电路就是将经常要用到的原理图（如半加器）作为一个模块，不仅可以使设计版图简洁，而且便于其他设计引用
6、有关ORCAD产生DEVICE的问题
用ORCAD出DEVICE文件时，它只默认原理图上所显示的元件的PIN连接来出，悬空的PIN 在DEVICE里的PINCOUNT没有统计进去，而且确定不了元件PIN 的数量（由于悬空没有显示）这样的话，做封装的时候很容易做错，如果没有DATA SHEET的话。

怎么样才能避免这个问题呢？在ORCAD里面如何显示元件的全部PIN呢？
原理图的脚和封装的脚有关系吗？做封装当然不能看原理图做了。

找DATASHEET建封装库吧
7、在ORCAD V9.23中如何更改PIN的“NAME”、“NUMBER”字体的大小和PIN的长短，以及GRID的间距？
pin的长短：选择元件点击鼠标右键，edit part,选择管脚鼠标右键/edit
properties/shape. name、number 字体大小是固定的，无法修改。

8、请问如何在orcad中填加新的元器件
方法一: 在原理图中加好元器件后,ECO到LAYOUT图.
方法二: 直接在LAYOUTL图里面用TOOL--->COMPONENT--->NEW功能增加元件.
9、ERROR: [DRC00031]
Package has same name but different source library
这是因为是什么原因?
可能是有两个元件使用相同的元件序号。

（我怎么看是：相同的封装来自不同的源连接库？？）
11 、capture中copy元件处理的问题
我的图是从其他*.DSN图上copy过来的，别人的图只有*.DSN 和 *.opj文件，copy过来以后的图发现上面的part的属性里source library和source package都不能改。

我看了capture的资料，里面说
Caution： An attached schematic folder or other file external to the project or library is not stored with the project or library. If you copy or move the project or library to a new location, you must also move or copy the attached object to keep them together. In addition, you may need to edit the path to the attached schematic folder or file if you move the project to a new location with a different directory structure.
大意是说copy的时候还有其他的附件也该一起copy，然后修改路径。

我想请问，像我现在这种情况，该怎么办呢，从新输入元件一个一个的修改，还是有其他的好办法。

ps，copy的原文件无法获得更多的资料了。

没必要改的，原理图到PCB LAYOUT传递的网表信息只是PART REFERENCE 和PCB FOOTPRINT 而已，你只要改FOOTPRINT NAME就行了，至于SOURCE LIB和SOURCE PACKAGE能不能改，无所谓（注：只有你的元件的PCB FOOTPRINT项是空的，才会用到SOURCE PACKAGE）
12、有什么快捷的办法让所有元件的封装以及值输出来
原理图是orcad/capture，加powerpcb
利用BOM表输出在COMBINED PROPERTY STRING项中加上{PCB FOOTPRINT}
13、请问高手，我在画电路图时，因为这个电路图是别人给我的，我要进行修改，可是元件库里有些元件是没有的，我要如何操作才能更快的得到想要的元件呢
我不想复制；是因为这个元件建立的不对。

如果说这个电路图中有的元件少PIN，怎么样才能加上去呢，急呀，谢谢先了！
选择元件，然后点击右键选edit part修改就可以了
14、请问大虾们，orcad如何导入powerpcb?
tools/create netlist/other/padspcb.dll,输出文件名后缀改为.asc即可。

15、capture DRC时出现：Off-Grid Objects
在session log中出现Off-Grid Objects，我看了help文件，但还是不明白什么叫Off-Grid Objects。

Reporting Off-Grid Objects
R78 - 08-POWER/LED/JTAG/CLOCK/OM (177.80, 222.50)
C128 - 08-POWER/LED/JTAG/CLOCK/OM (93.98, 49.53)
C129 - 08-POWER/LED/JTAG/CLOCK/OM (106.68, 49.53)
R81 - 08-POWER/LED/JTAG/CLOCK/OM (35.31, 271.78)
F1 - 08-POWER/LED/JTAG/CLOCK/OM (59.18, 38.10)
R75 - 08-POWER/LED/JTAG/CLOCK/OM (152.40, 208.53)
C121 - 07-LCD (137.16, 133.48)
把snap to grid关掉后，元件就不是按照网格来放置的。

所以统计是会出现这样的提示
请问有办法把not off-grid 的器件修正吗？
解决方法是在erc的时候把这个选项关了
16、CAM输出的文件,为什么电源和地的那层好象看不到什么内容,是不是所有的PCB的CAM 输出都是这样的？
看的到的，应该是十字化焊盘
17、有没有人知道怎么将PADS文件转换成ORCAD文件呀？有的话，请赐教！~！谢谢
将PADS文件输出为ASC格式，在ORCAD中应该就可以导入了。

18、在用CAPTURE时先画了个元件放到图上去了，后来发先画的有点问题，就回到那个元件库修改了一下，在回到原理图上，怎么也不能将新改的元件放上去它还是用的原先的那
个了，我想应该可一更新的吧！那位帮忙看一下呢？
在画的原理图上点中该元件,然后右键弹出菜单,有个edit part功能,进去后你就修改它好了,修改完后就update current就行了.一定改得过来的.
19、我用Orcad画完原理图，想用Powpcb画PCB
现在问题是Orcad中元件的封装的库如何加入，让Powpcb知道是采用什么封装的呢
这些PCB封装是在Orcad里画还是在Powpcb里画呢？特别是自己命名的一个新封装
封装在POWERPCB里画。

在ORCAD的CAPTURE里设定每个元件的FOOTPRINT与POWERPCB里的封装名相同即可
详细介绍见《用Orcad做原理图，用PADS layout》
20、我准备用ORCAD作原理图，然后作成allegro的网络表，可是我添加元件库的时候却发现可以添加*.olb和*.lib的库，请问两种库分别用在什么场合？
在allegro中何处可以看到元件封装库？
*olb是图形符号库文件即是原理图库，*.lib是仿真模型描述库文件利用Spice语言对Capture中的图形符号进行功能定义与描述。

*.llb是PCB封装库文件。

用olb 那个.lib是DOS版本的Capture的元件库文件
21、请问怎么可以把orcad原理图上的元件存到指定的元件库里
选中元件点EDIT PARTS，在编辑窗口选另存为。

22、求教protel的图怎么能转换成orcad能打开的
要先把PROTEL导出为ASCII文件，再用capture的file------import design才行，我用过，可以的
23、一个管脚比较多的器件在绘制原理图时如果只将它们放在一个图中会太大了，我想用两个或三个part来画，该如何设置呢，如何将它们在生成PCB时映射到同一个封装上去
三个部分的footprint都指定一个封装就行了；这个问题，请阅读Capture CIS的帮助－》Learn Capture Lesson Menu－》marking Parts
24、本人的一个part分成6部分U1A~U1F,在对各部分作编辑时,右击-->edit part,出现都是U1A的部分,而我要编辑其他部分该咂办?请问这个问题如何解决?
解决了,ctrl+N
25、Capture绘制完原理图后，用什么方法可以快速地填写器件封装信息？
方法一：
单页方式:点击电路图纸,CtrlA全选,菜单Edit-Properties,下面点选Parts,就可以对所以Part定义封装了;
方法二:
点击项目管理窗口,菜单Edit-Broser-Parts,在列出的Part中选择需要设定的Part,(注意可以用Shift和Ctrl进行复选),点击菜单Edit-Properties,在出现窗体中就可以快速填写封装信息了.
26、如何删掉cache里的part? Thanks!
只能删除多余的part，点击项目管理窗口中的Design Cache，然后点选菜单Design－Clearup Cache就可以了。

如果你修改了库元件，就存在cache和lib不一致的情况，update一下就好了
27、我的电路图有12张，在第3张和第10张都有+12V的电源，我检查DRC的时候为什么会有警告呢？请问不同页的同一电源怎么样才能连在一起？？
place power symbol把名字改一样就可以了阿!
28、我现有几张原理图但它们少一张总图关联，不知如何从子图生成层次试电路图，让它们网络相关连！谢谢！
如果要新建总图的话，还不如直接在原先的dsn文件里新建一张原理的方框图，使其变为make root，不就行了吗？上面那位土豆泥老兄的意思是问capture中有没有类似的命令（如像protel那样直接利用create symbol from sheet命令）生成方框图的快捷方法。

29、我现在手头上有ORCAD的原理图，现在想从该原理图中得到元件库(lib)。

请问各位大侠在ORCAD中是否有该功能？谢谢！
解答：
file－new一个library，然后把Design catch里面的零件复制到library中就可以了。

30、我用Orcad画好了一份手机原理图，网表也给了PowerPcb并制成了PCB板，调试通过并已量产。

意思就是说在原理图的电气特性都是正确了！现在遇到出BOM的问题，正常的BOM（Item Quantity Reference Part Description PCB Footprint Vendor)
没问题，现在需要加上几个属性（如Manufacturer，Order Number，Part No.），如果在每个元器件上EDIT，加上以上几个属性自然没问题，但是一个一个的加，几百个Part，加死了！！听说有个方法导入什么文件，可以让所有的Part都加上以上几个属性，然后我在填上具体的值，一出Bom就搞定了。

不知那位大侠可以切磋，指点一下！！
解决方法一: 使用CIS,不过你们公司暂时没有也没法.
解决方法二:不用把设定带入原理图的话就在EXCEL中Key就可以了,很多公司只样做.
解决方法三:使用Update propetry,有些复杂,自己有空研究好了!
32、我做好了一部分图纸,发现图幅小了,要将图幅变大,在Options>Design Template改了图幅的设置,可在SCH中图纸大小没变?
你是在没有打开schematic的界面下设的吧？！你先打开一张图，选options -->schematic page propeties,在这里改应该可以！
33、将原理图中的一页，分散放到其他页后，在导出.asc的网表时，出现了很多如下的warning。

不得其解。

WARNING: Name contains illegal characters +5V , changed to PLUS5V
WARNING: Name contains illegal characters D+5V , changed to DPLUS5V
WARNING: Name contains illegal characters Version
Document , changed to Version_Document
ERROR [NET0011] Netlist failed or may be unusable.
1,+5v连接有误,要么你的+5V没加电源标示,或是没有OFFPAGE,看情况而定.
2,错误同上.
3,版本号没改.
4,网表不能产生.
将这些错误改改,就行了.
34、在ORCAD中，要用到一个管脚很多的器件，不想用大图，想将其分割为几个部分，试了许多次都不行，谁能指点一下？
一定要新建元件后,Parts per Pkg选择要分割元件数,Package Type选Heterogeneous即可
35、我一直是用CONCEPT-HDL和ALLEGRO，SPECCTRAQUEST，现在有一块板子想做原理仿真和PCB仿真，所以初步计划用CAPTURE CIS设计原理图，仿真后导入ALLEGRO，在做PCB
仿真。

不知CAPTURE 和ALLEGRO的接口是不是方便使用，需要注意哪些问题？
还有CAPTUE中我的许多器件没有，我不知怎么建库？那位大侠有好的帮助文章给一些，或者哪里有下载的电子文档？还请告知。

本人不胜感激
Capture与Allegro接口没有任何问题，因为它们现在本身是一家。

要注意的是器件的管脚名除电源外不能同名，哪怕是NC管脚也必须定义为NC1、NC2、.。

教程网上很多，搜索一下应该能找到。

36、我做了一个小板子，上面有四个公插件，四周有四个螺丝孔。

现在要做一个大板子，把小板子放在上面，母插座正好对着公插座，螺丝孔要对齐，我想把小板子做为一个元件封装调入到大板子上，这样对齐比较容易。

问怎么把这个小板子做成封装？请高手指点
解答一：你想做成封装,应该不行吧,我个人认为应该是把你的小板子的零件做成list文件,在allegro中右边中Find by name选它的function为symbol or(pin),在下面的小框框中keyin你的list文件,且在Find by name 对齐的function 应要选择List,应该就OK. 还有就是你的大板子里也一定要转Netin才行哦
解答二：我师傅做几个板子相叠加时，都是把上面的小板子的外框和接插件做成库元件（板框做成元件封装，接插件做成焊盘），然后调入到大板子上面，如果放上去正好和螺丝孔相对，就删掉，因为大小板子相连时是用排线相联的。

这样在安装时会非常精确的。

但是他现在走了。

37、大家做sch时，capture cis用处大么？另外BGA的封装怎样用字母序列标注管角号码？
CIS：Component Imformation System，至于好处一次说不完，主要是对一个企业的零件库管理功能，一个简单例子：就是你可以在place part的时候就可以看到该零件的所有信息（包含零件料号，值，元件描述，价格，公司库存，封装外形，元件datasheet……），对于工程师来说好处就是产生BOM一次搞定，而不要再去填什么零件料号，元件描述什么信息了，主要是减少了出错的机会。

字母标管脚不是直接输入字母给pin就可以了吗？
38、ORCAD的PART的VALUE有什么作用呢，我一同事说不同类型的器件的VALUE不能相同，因为如果相同生成DEVICE，会有问题，举个例子——————我有一33欧姆的电阻，一33欧姆的4脚排阻，则在原理图中，VALUE值不能都写成33，而可以写成R33，33才可以。

这是什么原因呢，哪位大侠能不能解释一下呢，谢谢
如果不同类型器件value值一样，在列器件清单时会把不同类的元件放在一起，象你上面所说的情况，就会认为是2个33欧电阻，而不加以区分。

39、在Capture中可以通过Properties某些属性的设置为将来的Aleegro PCB布板进行准备。

请问：这样的属性有哪些？尤其是与网络有关的，比如差分对，它的名称，线宽，线距是否可以在这些属性中的某一项事先设定，然后带到Allegro中。

解答：在edip property时，filter by选：Cadence-allegro就可以看到有哪些可以转了；至于差分对，线距什么的只能定义名字，具体需要在allegro指定值，像min_line_width 可以直接定义多少。

40、在一张capture 中画了电路图,并将图中所有元器件做了一个.olb库文件.在单独打开这个库,对元件进行编辑时一些正常.但是如果在Capture中使用元件管理器时,选中一个元件,在右键菜单点击察看时,在元件管理器窗口确看不到这个元件的图形(参数倒是有),并
提示:"Coud not read part information form WAG/CAP",表示无法读出CAP电容信息.
错在什么地方?请问如何设置CIS?
Part Manager是CIS的功能，你没有设置好CIS所以提示错误！2-〉看帮助文件，很详细
42、在orcad中一个project的dsn里面的两张page的相同信号怎么接到一起啊？
放置一个分页符不就可以了么，OFF PAGE。

OFF PAGE名称一致才可以
但是，现在我的两张page中连不到一起去的net不是单根线的net
而是bus连不到一起去
好像page off连不到bus上吧
不知兄有何高见？
注意两页的Off Pages画成总线形式,如DATA[1..31]
43、错误代码如下： Spawning "D:CadencePSD_15.1 oolscapturepstswp.exe" -pst -d "d:oardworkvermont.dsn" -n "D:BOARDWORKAllgero" -c "D:CadencePSD_15.1 oolscaptureallegro.cfg" -v 5 -j "PCB Footprint" Scanning netlist files Loading D:BOARDWORKAllgero/pstchip.dat Loading D:BOARDWORKAllgero/pstchip.dat Loading D:BOARDWORKAllgero/pstxprt.dat Loading D:BOARDWORKAllgero/pstxnet.dat Error: Line 914 in file D:BOARDWORKAllgero/pstxnet.dat: Reference designators inconsistent in xprt and xnet files Detected in function: pstFindInstByOldPathName Error: Line 914 in file D:BOARDWORKAllgero/pstxnet.dat: Error loading the net list file Detected in function: ddbLoadPstXFiles #1 Error [ALG0036] Unable to read logical netlist data. Exiting "D:CadencePSD_15.1 oolscapturepstswp.exe" -pst -d
"d:oardworkvermont.dsn" -n "D:BOARDWORKAllgero" -c "D:CadencePSD_15.1 oolscaptureallegro.cfg" -v 5 -j "PCB Footprint"
*** Done ***
pstxnet.dat的第912－913行是：
NODE_NAME R372 2 ''''''''''''''''@VERMONT.TOP(SCH_1):PROTOCARD
0@VERMONT.AD(SCH_1):I164594160@DSPANDFPGA.RESISTOR.NORMAL(CHIPS)''''''''''''''' ': ''''''''''''''''2'''''''''''''''':;
allegro可以导入列表，但是rats连地线都没有连接啊
请问怎么解决这个问题？
这个问题的解决方法是一个一个删除报错的器件，再拷贝一个相同的器件过来。

不过每次Netlist只报一个错，有点郁闷。