设计一个同步5进制加法计数器

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1
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J0
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n
2
K
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Q
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2
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n
00 0
解:本题是同步计数器的设计,分析步
S0
S1
S2
骤如下:
(1)根据设计要求,设定状态,画出状态
转换图。该状态图不须化简。
S4
S3
(2)状态分配,列状态转换编码表。
文档仅供参考,不能作为科学依据,请勿模仿;如有不当之处,请联系网站或本
(3)选择触发器。选用人JK删触除。发器。
(4)求各触发器的驱动方程和进位输出方程。
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10 ×
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模块3 用JK触发器实现计数器功能
➢任务:
1. 设计一个同步5进制加法计数器
2. 设计一个同步5进制减法计数器
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时序逻辑电路设计的步骤
➢ (1)根据设计要求,设定状态,画出状态转换图。该状 态图不须化简
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作业
➢设计一个同步8进制减法计数器(选用JK触 发器)
➢P247 7.2
设计一个同步5进制减法计数器
➢ (1)根据设计要求,设定状态,画出状态转换图。该状 态图不须化简
➢ (2)状态分配,列状态转换编码表。 ➢ (3)选择触发器 ➢ (4)求各触发器的驱动方程和进位输出方程。 ➢ (5)将各驱动方程与输出方程归纳,画出逻辑图 ➢ (6)检查电路能否自启动并说明其逻辑功能。
➢ (2)状态分配,列状态转换编码表。 ➢ (3)选择触发器 ➢ (4)求各触发器的驱动方程和进位输出方程。 ➢ (5)将各驱动方程与输出方程归纳,画出逻辑图 ➢ (6)检查电路能否自启动并说明其逻辑功能。
文档仅供参考,不设能作计为一科学个依同据步,人请5删勿进除模。制仿加;如法有计不当数之器处.,请联系网站或本
(5)将各驱动方程与输
11 × × ×
出方程归纳如下:
(6)画逻辑图。
Q2
Q1
Q0
∧ ∧ ∧
Y 进位输出
Q 1J& C1
1K
Q 1J C1
1K
Q 1J C1 1K
CP
(文档7)仅供检参查考,能不否能自作为启科动学依据,请勿模仿;如有不当之处,请联系网站或本
人删除。
利用逻辑分析的方法画出电路完整的状态图。
Q2Q1Q0 /Y
111
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110
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001 /0 010
/1
/0
100
/0 011
可见,如果电路进入无效状态101、110、111时,
在CP脉冲作用下,分别进入有效状态010、010、
000。所以电路能够自启动。
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列出JK触发器的驱动表,画出电路的次态卡诺图。
Q
n Q1nQn000
2
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Q
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2
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