数电 减法计数器
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目录
1 三位二进制同步加法计数器(010,111) (1)
1.1课程设计的目的 (2)
1.2设计的总体框图 (2)
1.3设计过程 (2)
1.4逻辑电路图 (4)
1.5实际电路图 (4)
1.6实验仪器 (5)
1.7实验结论 (5)
2 串行序列信号发生器的设计(检测序列010100) (6)
2.1课程设计的目的 (6)
2.2设计的总体框图 (6)
2.3设计过程 (6)
2.4 逻辑电路图 (8)
2.5 实际电路图 (9)
2.6实验仪器 (9)
2.7实验结论 (9)
3 十六进制同步加法计数器(用74LS191集成芯片做) (10)
3.1课程设计的目的 (10)
3.2设计的总体框图 (10)
3.3设计过程 (10)
3.4 74191的状态表 (10)
3.5 芯片介绍 (10)
3.6 逻辑电路图 (11)
3.7实际电路图 (11)
3.8实验仪器 (12)
3.9实验结论 (12)
3.10参考文献 (12)
1 三位二进制同步加法计数器(010,111)
1.1课程设计的目的
1、了解同步加法计数器工作原理和逻辑功能。
2、掌握计数器电路的分析,设计方法及应用。
3、学会正确使用JK 触发器。
1.2设计的总体框图
CP
Y
1.3设计过程
(1)状态图:
(2)选择的触发器名称:
选用三个CP 下降沿触发的边沿JK 触发器 (3)输出方程:
Y= n
Q 2n
Q 1Q 0n
(4) 状态方程:
图1.1.1 3位二进制同步加法计数器的次态卡诺图
、
图1.1.3 Q 1n+1
的卡诺图
图1.1.4 Q 0n+1的卡诺图
由卡诺图得出状态方程为: 1
2+n Q = n Q 1Q 2n +n Q 1n
Q 2
11
+n Q = Q 0n n Q 1
1
0+n Q =n Q 1n
Q 0+n Q 2n Q 1Q 0n
(5) 驱动方程:
2J = Q 1n
1J = Q 0n
0J =n
Q 1
2K =n
Q 1 1K =1 0K =
Q
Q n n 1
2
(6) 判断能否自启动
010→100→101;111→000→001 所以能进行自启动
1.4逻辑电路图
5 V
图1.1.5 逻辑电路图
1.5实际电路图
图1.1.6 实际电路图
1.6实验仪器
(1)数字原理实验系统一台
(2)集成电路芯片:74LS112二片 74LS08一片
1.7实验结论
经过实验可知,满足时序图的变化,产生000→001→011→100→101→110→000的序列。
2 串行序列信号发生器的设计(检测序列010100)2.1课程设计的目的
1、了解串行序列信号发生器的工作原理和逻辑功能
2、掌握串行序列信号发生器电路的分析,设计方法及应用。
2.2设计的总体框图
CP
Y
串行序列输出2.3设计过程
(1)状态图:
(2)状态方程:
所以得到
Q
Q
Q
Q n
n
n
n
Y
2
1
2
图1.2.1 3位二进制同步加法计数器的次态卡诺图
图1.2.3 Q1n+1的卡诺图
图1.2.4 Q0n+1的卡诺图
由卡诺图得出状态方程为:
Q 2n+1=Q n 2 Q n 1 + (Q n 0+Q n 1)Q n 2
Q 1n+1= Q n 1+ Q n 0Q n 1
Q 0n+1 = Q n 0 + Q n 2Q n 1
(3) 驱动方程:
2J =n
Q 1 Q 0n
1J = 1 0J = n
Q 1
2K =n
Q 1Q 0n 1K = Q 0n
0K =n
Q 1
(4)判断能否自启动
000→010→011;100→110→111 所以能进行自启动
2.4 逻辑电路图
图1.2.5 逻辑电路图
2.5 实际电路图
图1.2.6 实际电路图
2.6实验仪器
(3)数字原理实验系统一台
(4)集成电路芯片:74LS112二片 74LS08一片 74LS00一片2.7实验结论
经过实验可知,满足时序图的变化,产生101110的序列。
3 十六进制同步加法计数器(用74LS191集成芯片做)
3.1课程设计的目的
1、了解多位同步加法计数器工作原理和逻辑功能。
2、掌握计数器电路的分析,设计方法及应用。
3、学会正确使用集成芯片。
3.2设计的总体框图
CP Y
3.3设计过程
状态图:
→0111→1000→1001→1010
↓
←1110←1101←1100←1011
3.4 74191的状态表
3.5 芯片介绍
U /D 为加减计数控制端;CT 是使能端;LD 是异步置数控制端;CP 是计数脉